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RSS订阅原创 Verilog设计模为三位数的计数器
代码实现了一个计数器模块，通过输入时钟信号 CLK、复位信号 RST、使能信号 EN 和参数 M，以及内部的计数器和逻辑电路，实现了基于分频的计数器功能，并将计数结果分别显示在三个4位的数码管上。
2023-10-24 23:02:58
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原创 探究插值抗镜像 FIR 低通滤波器的参数对插值结果的影响
实验结合了插值抗镜像 FIR 低通滤波器的整个设计过程来具体分析其参数对插值后结果的影响。
2023-10-01 21:35:48
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原创 HTML＋CSS＋JS 登录页面的代码结构入门
本作品创建了一个代码简单清新的登录界面，整体简明，并具有一定的交互功能，可以在此基础上增加更多的功能或细节
2023-09-27 19:32:17
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原创 药片瓶装生产线简易控制系统电路设计
该工程案例是一个典型的数字系统应用案例，需要运用课程中学习到的逻辑门、编码器、显示译码器、数码管、比较器、计数器和单稳态触发器等知识与技术方法。
2023-09-23 20:40:09
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原创 药片瓶装生产线简易控制系统
该工程案例是一个典型的数字系统应用案例，需要运用课程中学习到的逻辑门、编码器、显示译码器、数码管、比较器、计数器和单稳态触发器等知识与技术方法。仿真电路使用了电路设计软件Proteus 8 。
2023-09-22 17:39:35
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原创 模拟数字钟设计
用74161或74160和与非门实现计时器的“分”电路：00—59循环计数。在此基础上，实现24小时计时。具体来说，要求实现数字钟的设计与仿真，该数字钟具有准确计时，校时，以数字形式显示时、分等功能。（秒的设计不考虑，将每分钟时间设计为1s）
2023-09-22 16:17:49
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原创 实验四 用集成移位寄存器实现序列检测器
用移位寄存器和与非门设计一个 1101 序列检测器。电路连续不停地工作，对 串行输入的序列进行检测，当连续检测 4 个码元符合检测码 1101 时，检测器输出 为 1，指示灯亮，其他情况下输出为 0，指示灯灭。
2023-09-21 10:52:54
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原创 实验三 集成触发器应用-抢答器设计
用D触发器和与非门设计智力竞赛4人抢答电路，设有4个开关（S0~S3），另有4个指示灯，第一抢答者（第一个按下开关时）所对应的指示灯亮，其它三个开关任一个再按下时，其它三个指示灯也不会亮。
2023-09-21 10:17:42
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数字电路逻辑设计药片大作业
2023-09-23
空空如也
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