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本文介绍了基于VHDL的RISC微型处理器设计，包括使用Vivado 2018.2进行工程创建和仿真。设计中包含了decoder、ROM和ALU组件，通过信号连接实现指令解码、地址生成和算术逻辑运算等功能。
assignment 共有3个part
最后需要完成的设计如下图所示：
工程使用vivado2018.2创建，并且仿真，如下图所示：
仿真波形图：
library IEEE;
use IEEE.STD_LOGIC_1164.ALL;
use work.pp_types.all;
-- Uncomment the following library declaration if using
-- arithmetic functions with Signed or Unsigned values
--use IEEE.NUMERIC_STD.ALL;
-- Uncom
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