ViVado报错记录及解决方式

请查看原文获取最新更新内容:https://yuhengwei2001.github.io/article/Vivado_Log_Resolution.html

Generate Bitstream Failed

[DRC NSTD-1]

• 问题
  引脚定义了，没有使用或者没做物理约束导致生成bit文件报错，DRC电气检测失败。此处特指顶层文件输入输出引脚。

• 解决

  1.找到未使用引脚并注释。

  2.使用TCL文件忽略该项报错,TCL文件内容如下，手动创建该文件后，在Vivado右栏选择Setting->Project Settings->Implementation->Write Bitstream->tcl.pre选择该文件并导入后重新执行Generate Bitstream。

  set_property SEVERITY {Warning} [get_drc_checks NSTD-1]
  set_property SEVERITY {Warning} [get_drc_checks UCIO-1]
  set_property SEVERITY {Warning} [get_drc_checks RTSTAT-1]
  

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Run Implementation Failed

[DRC UTLZ-1]

Resource utilization: DSP48E1 over-utilized in Top Level Design (This design requires more DSP48E1 cells than are available in the target device. This design requires 1211 of such cell types but only 900 compatible sites are available in the target device. Please analyze your synthesis results and constraints to ensure the design is mapped to Xilinx primitives as expected. If so, please consider targeting a larger device.)

• 问题
  提示很明显指出,DSP资源不足.

• 解决
  点击 Open Synthesized Design -> Report Utilization 查看各个模块DSP使用情况,优化DSP使用.一般需要关注DDS,FIR,CFR等模块.

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Run Synthesis Failed

[Synth 8-5535]

port <sys_clk> has illegal connections. It is illegal to have a port connected to an input buffer and other components. The following are the port connections : Input Buffer: Port I of instance clkin1_ibufg(IBUF) in module <clk_wiz_0_clk_wiz> Other Components: Port C of instance sys_rst_n_reg(FD) in module ddr3_rw_top

• 问题
  顶层时钟引脚未经过IBUF直接使用会导致此错误

• 解决
  使用IBUF和BUFG原语将时钟导入输入时钟缓冲和全局时钟缓冲后使用。IBUFG即输入全局缓冲，是与专用全局时钟输入管脚相连接的首级全局缓冲。所有从全局时钟管脚输入的信号必须经过IBUF元，否则在布局布线时会报错。 IBUFG支持AGP、CTT、GTL、GTLP、HSTL、LVCMOS、LVDCI、LVDS、LVPECL、LVTTL、PCI、PCIX和 SSTL等多种格式的IO标准。BUFG
  是全局缓冲，它的输入是IBUFG的输出，BUFG的输出到达FPGA内部的IOB、CLB、选择性块RAM的时钟延迟和抖动最小。

Others

[USF-XSim-62]

‘compile’ step failed with error(s). Please check the Tcl console output or ‘/xxxx/xxx/xxxx/xxxxxx.sim/sim_1/behav/xsim/xvlog.log’ file for more information.

• 问题
  行为仿真出现错误,大概率是语法错误，打开提示中指定的xvlog.log文件或查看Tcl控制台即可查看错误。
• 解决
  根据xvlog.log详细提示解决问题。若已经解决且编译通过还显示此提示，选择此条提示->右键->Discard User Created Messages然后重新编译即可。

Unable to open file <file> because the path is invalid

• 问题
  突然发现文件无法打开，但使用Vscode可以在路径下找到文件，且使用Vivado GUI可以打开文件。该文件存在，但无法通过Messages栏打开。
• 解决
  打开…/projectName.runs/synth_1/runme.log文件，这个是编译日志，Message栏的信息就是由这个文件生成。观察日志，发现项目名称中出现了纯数字，猜测Vivado无法识别纯数字路径。修改掉路径，重新编译，该错误解决。

原文地址:https://yuhengwei2001.github.io/article/Vivado_Log_Resolution.html