Xilinx ZYNQ7035 PL Cameralink回环实现

最新推荐文章于 2024-07-06 16:59:50 发布
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文章标签： fpga开发 硬件架构 嵌入式硬件 udp 网络协议
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本文主要介绍说明XQ6657Z35-EVM评估板Cameralink回环例程的功能、使用步骤以及各个例程的运行效果。
（基于TI KeyStone架构C6000系列TMS320C6657双核C66x 定点/浮点DSP以及Xilinx Zynq-7000系列SoC处理器XC7Z035-2FFG676I设计的异构多核评估板，由核心板与评估底板组成。评估板CameraLink功能支持2路Base输入、或者2路Base输出、或者1路Full 输入或输出）

ZYNQ7035 PL Cameralink回环例程
1.1.1例程位置
ZYNQ例程保存在资料盘中的Demo\ZYNQ\PL\base_cameralink_loop\prj文件夹下。

1.1.2功能简介
Cameralink回环例程将J3、J4当作两个独立的Base Cameralink接口使用，一个接收，另一个发送。
Cameralink接收端，利用Xilinx ISERDESE2原语进行串/并转换，将LVDS串行数据转换成28bit的cameralink并行数据。解串后的并行数据通过ila进行在线分析和查看，并实时检测并行数据是否有误码。
Cameralink发送端，利用Xilinx OSERDESE2原语进行并/串转换，将本地28bit cameralink并行数据串行化为LVDS数据发送出去。

1.1.3Cameralink接口时序说明
1.1.3.1Cameralink三种配置模式
在这里插入图片描述

Base模式：只需一根Cameralink线缆&#

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