基础——(5)D Flip-Flop(D触发器)

最新推荐文章于 2024-06-29 17:40:51 发布
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本文介绍了D Flip-Flop（D触发器），它是D-Latch的时钟控制版，用于在时钟脉冲到来时捕获输入信号。讨论了如何通过反相器和电容电阻网络创建短暂的时钟脉冲，并比较了D触发器与D-Latch的主要区别。此外，还提及了JK触发器的相关内容。

摘要生成于 C知道 ，由 DeepSeek-R1 满血版支持， 前往体验 >

之前搞了一个 D-Latch，看一下下图是怎么变化的

 

 

In D-latch anytime its enabled the input D is going to be output at Q

 

使用clk

 

通常情况下clk输入是这样的，很短很短的一下:

 

 

这个很短的脉冲是怎么实现的呢?

答案:

 

可以用下面的东西:

输入为0的时候inverter里面是1 当从0切换到1的时候 invertor里面的1不是瞬间变成0的，此时会产生一个很短的脉冲

还可以用电容加电阻来实现:

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