电平触发和边沿触发——数电第五章学习

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文章标签： 数电 学习
于 2022-03-22 10:13:13 首次发布
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本文详细介绍了电平触发和边沿触发的概念，包括D触发器、CMOS传输门组成的触发器以及带有异步置位、复位端的触发器。电平触发在CLK有效电平时根据输入信号改变状态，可能导致不稳定，而边沿触发仅在时钟信号上升沿或下降沿时更新状态，提高了抗干扰能力。边沿触发器的响应速度更快，适用于需要快速响应的应用，而电平触发则适用于对时间要求不高的场景。两者在触发机制和应用场景上有显著区别。

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触发

触发器和锁存器的不同之处在于，它增加了一个触发信号输入端，只有当触发信号到来时，触发器才能按照输入的0、1置成相应状态。这个信号也称为时钟信号CLOCK(CLK)

电平触发

普通触发

在这里插入图片描述
（1）只有当CLK变为有效电平时，触发器才能接受输入信号，并按输入信号将触发器置为相应的状态；在CLK＝1的全部时间里，S和R的变化都将引起触发器输出端状态的改变。（所以引入一个问题，在有效电平期间，若S、R的状态多次发生变化，则输出的状态也将也将多次发生翻转，容易造成触发器的不稳定，在下图中有图文解释）

（2）而当CLK为无效电平时，门的输出状态始终停留在1状态，故输出保持原有状态不变。

在这里插入图片描述
我们从这张图中可以看出S输入了一个干扰信号，对Q的输出产生了干扰。

D触发器

为了能适应单端输入信号的需要，将电路改接成下图形式，称为D触发器。

在这里插入图片描述<

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