fpga-verilog

最新推荐文章于 2024-05-07 18:05:09 发布
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assign #2 sum = 2;   //  #2 延迟2个时间单位， 具体单位在‘timescale 1ns/100ps定义，100ps是精确的时间单位

assign 语句是并发执行的， 连续赋值语句，只要右边的值发生变化，就会执行赋值动作

initial 执行一次

always 永久循环执行

只有reg变量才能在initial和always中赋值


jack5588liu270
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