W25Q128
器件的基本介绍
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W25Q128是一个可以存储声音、文本和数据的一个芯片,支持双/四SPI
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W25Q128的存储架构
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存储架构:256块,每块有16个扇区,每个扇区有16页,每页有256个字节
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容量的计算(2^8x2^4x2^4x2^8=2^24字节B=2^14KB=2^4MB=16MB 、1kB=2^10B、1MB= 2^10KB、
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W25Q128JW支持标准串行外设接口(SPI)、双SPI、四SPI:串行时钟、片选信号、串行数据I/O0(DI)、I/O1(DO)、I/O2和I/O3,支持的时钟最大是133MHz
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特性
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器件名称、容量、接口
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存储架构:
框图、内部结构
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PCB图
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框图
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引脚说明
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CS片选信号、低电平有效
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DO数据输出
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DI数据输入
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CLk 时钟信号
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时序
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标准SPI接口,支持模式0和模式3,模式0空闲状态下SCK为低电平,模式3空闲状态下SCK为高电平
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指令部分:要发送指令,是FPGA向Flash发送
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Write Enable写使能06h
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除了读之外,在执行所有的操作指令之前都有先发送写使能指令,然后Flash才能正常工作,状态寄存器写使能指令位置1;
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发送写使能时序
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一次发8bit,高位先发
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Read Data 页读03h
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Page Program 页写02h
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页写之前要先进行全擦除,然后再发送页写指令+地址+数据
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最多一次发送256字节,
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Chip Erase 全擦除C7h/60h
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全擦除指令的作用是将寄存器全部为1;
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全擦除指令发送前,要先发送写使能指令,全擦除完成后状态寄存器中的写入启用锁存器(WEL)位将重新变为0。
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等待时间
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发送全擦除指令时序
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C7-1100_0111,60h-0110_0000
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串行输入时序
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注:
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除了读数据以外,时钟频率最大为104MHz
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读数据时钟频率最大为50MHz
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CS建立时间向对于CLK:tSLCH最小5ns,tCHSH最小3ns
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tSHSL读的时候最小为10ns,擦除或写的时候最小为50ns