硬件描述语言实验八：触发器实验

最新推荐文章于 2025-03-12 08:24:27 发布

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分类专栏：硬件描述语言文章标签： fpga开发硬件工程网络测试工具

本文链接：https://blog.csdn.net/li3439253684/article/details/137912158

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预习报告部分

实验目的：初步练习VHDL语言时序逻辑的描述方法，即触发器的描述方法。
实验原理：

1.一个同步清零的JK触发器，实体名称为“ff_jk”，其引脚名称和逻辑功能如下表所示。

输入				输出
clk	clr	j	k	q	nq
↑	0	X	X	0	1
↑	1	0	0	保持	保持
↑	1	0	1	0	1
↑	1	1	0	1

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