第二章 FPGA知识大串讲02_知识串联

最新推荐文章于 2024-04-20 18:00:00 发布
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作者：潘文明本文为明德扬原创文章，转载请注明出处！

在上一篇文章中，我们概括地讲述了FPGA的一些学习误区。本文我们将FPGA的关键知识串联起来，系统地介绍各个知识点所处的层次和位置，为后面几仿篇文章的详细讲解做好铺垫。

第1节 FPGA的基本电路结构

首先，我们来讲解一下FPGA的基本电路结构。请看上图中左边红色方框，该方框内包含了组合逻辑电路以及一个D触发器。组合逻辑里可能是加法器、减法器、选择器，甚至是什么都没有，就是连线；组合逻辑的输出将连接到D触发器的输入端；D触发器在时钟的驱动下，将组合逻辑的运算结构，输出到D触发器的输出端。

这就是一个FPGA的基本电路结构，而这个电路结构则与VERILOG中的一个ALWAYS对应，如下面的代码

上面代码在综合器的作用下，其综合的FPGA电路结构，也是组合逻辑+D触发器的形式。其中组合逻辑由比较器(cnt==0、cnt==1、cnt==2就是比较器)、选择器（从1、2、3或者保持不变中选择）等组成；D触发器的时钟就是代码中的clk，输入则是组合逻辑的结果

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明德杨
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