FPGA的配置方式PS——Passive serial

最新推荐文章于 2024-04-19 13:35:12 发布
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分类专栏： FPGA 文章标签： parallel as flash fpga 硬件
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本文链接：https://blog.csdn.net/pad_nuannuan/article/details/30559905
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本文介绍了FPGA的Passive Serial配置方式，详细阐述了配置过程、硬件连接和所需信号，包括nCONFIG、nSTATUS、DCLK、DATA0等。通过使用Altera的Parallel Flash Loader IP核，简化了CPLD对FPGA配置的复杂操作。
摘要由CSDN通过智能技术生成

    FPGA的配置方式，很多种，前一段时间主要用了一下PS——Passive serial，被动串行的加载方式。在这个模式下，FPGA被动的等待配置起始信号，然后接受配置文件，完成配置。即每次在FPGA上电时，由外部器件完成FPGA的配置。

    这个方式的实现（或者说选择），是由FPGA的硬件连接来完成的，硬件连接如下图：


MSEL这组信号决定了FPGA的配置方式：


（根据官方文档的说明，这两个管脚不要连接

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