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Verilog入门——全加器设计及例化语句应用
【代码】Verilog入门——全加器设计及例化语句应用。原创 2024-01-18 12:35:18 · 605 阅读 · 1 评论 -
Verilog入门——4选1多路选择器及条件语句表述方式
【代码】Verilog入门——4选1多路选择器及条件语句表述方式。原创 2024-01-18 10:36:29 · 729 阅读 · 1 评论 -
Verilog入门——4选1多路选择器及条件赋值语句表述方式
【代码】Verilog入门——4选1多路选择器及条件赋值语句表述方式。原创 2024-01-17 20:33:05 · 1093 阅读 · 0 评论 -
《EDA技术实用教程(第六版(黄继业, 潘松))》学习笔记——第三章
reg: 寄存器型变量;在过程语句always@引导的顺序语句中, 被赋值信号规定必须是reg型变量;输入或双向口信号不能定义为reg型。如果assign语句中需要有端口以外的信号或连接线性质的变量(由于端口都已默认为网线型变量),则必须用网线型变量定义语句事先给出显式定义。用wire定义的网线型变量可在任何类型的表达式或赋值语句(包括连续赋值和过程赋值语句)中用作输入信号,也可以在连续赋值语句或实体元件例化中用作输出信号。原创 2024-01-16 17:34:43 · 2801 阅读 · 1 评论 -
Verilog入门——4选1多路选择器及case语句表述方式以及详解
【代码】Verilog入门——4选1多路选择器及case语句表述方式以及详解。原创 2024-01-15 20:49:58 · 2759 阅读 · 0 评论 -
《EDA技术实用教程(第六版(黄继业, 潘松))》学习笔记——第二章
LE是Cylone 4E FPGA器件的最基本的可编程单元, LE主要由一个4输入的LUT、进位链逻辑、存器链逻辑和一个可编程的寄存器构成。在FPGA开发中,JTAG口更多地被用在对其进行编程、配置、内嵌存储器内容的测试编辑,以及处理器内核系统的软硬件测试和调试。MAX3000A结构中包含五个主要部分,即逻辑阵列块、宏单元、扩展乘积项(共享和并联)、可编程连线阵列、I/O 控制块。的一款低功耗、高性价比的FPGA,它的结构和工作原理在 FPGA 器件中具有典型性。,即可编程的与阵列和固定的或阵列组成。原创 2024-01-15 10:24:18 · 2332 阅读 · 1 评论 -
Verilog入门——半加器电路模块的Verilog描述以及详解
Verilog入门——半加器电路模块的Verilog描述以及详解原创 2024-01-13 15:04:49 · 559 阅读 · 0 评论 -
《EDA技术实用教程(第六版(黄继业, 潘松))》学习笔记——第一章
EDA技术就是以计算机为工具,设计者在EDA软件平台上,用硬件描述语言VerilogHDL完成设计文件,然后由计算机自动地完成逻辑编译、化简、分割、综合、优化、布局、布线和仿真,直至对于特定目标芯片的适配编译、逻辑映射和编程下载等工作。内容包含:IC设计制造、FPGA/CPLD应用、PCB(印刷电路板)设计。原创 2024-01-13 13:04:33 · 1580 阅读 · 14 评论