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转载 quartus ii 增量编译

首先,得先看看QuartusII的编译过程是个怎么样的,要了解这个过程很简单,看看下面这张图,谁都不陌生:当我们点全编译之后,下面的几个过程就会一个一个打上勾,而我们编译的过程也就是和这个运行过程是一致的:先是分析综合,再是布局布线,然后是汇编(这里不是指汇编语言的汇编,而是说将布局布线后的“电路”汇编成可下载到芯片内的“程序”,即.sof文件,在配置FPGA时候使用到的文件后缀),还有时...

2018-12-27 21:59:00 4571

转载 modelsim仿真ISE工程时出现# ** Error: (vlog-19) Failed to access library 'rtl_work' at "rtl_work

今天在使用ISE调用Modelsim的时候,遇到下面图1的错误:图1 Modelsim出现的错误 找了半天解决方法,找到了下面的解答(http://blog.sina.com.cn/s/blog_6e394a3d0101722o.html)。 通常情况下一台电脑上即装有ISE,又装有quartus ii且二者的仿真库都在modelsim里编译好,在用modelsim仿真过q...

2018-12-27 18:07:40 7445 4

原创 Xilinx Spartant6 DDR3 IP核的创建

新建一个ISE工程,然后创建一个Ip核。选择MIG Virtex-6的ip,双击。1.双击打开IP核设置的界面。​点击next2.第二个界面​然后点击next3.第三个界面​我们这里不勾选,直接next4.​FPGA的原理图,由图可知这块板子的...

2018-12-26 21:33:23 1957 1

原创 AD在画PCB的时候,拖动器件,PCB布线可以一起移动方式

AD在原理图中,移动器件,想要布线也一起移动,按住ctrl即可。在PCB中,想要布线和器件一起移动,按快捷键E然后选择移动-----拖动线段头   然后再去拖动器件即可。...

2018-12-26 13:09:15 36884 3

原创 FPGA驱动USB芯片的读测试

 上一篇说道了写时序,今天来讲讲读时序。1.USB芯片读时序图由此可以看出他用到的信号线是 ifclk,slrd,flag_empty, usb_fdata, sloe,slcs这几个引脚。所以就要写程序去满足他的时序。 写程序前想的时序: write时序中,使用的是FIFO的满标志,read时序中,使用的是FIFO的空标志。2.代码:// ***********...

2018-12-26 10:58:03 1559

原创 FPGA驱动USB协议芯片的测试

 实验的开发板:黑金AX516 开发板本篇讲解如何向USB协议芯片写入数据。1.USB协议芯片引脚功能 主要的需要配置的功能引脚 数据引脚  有用的引脚 ifclk , //同步时钟 s_rst_n , usb_full , //满标志 usb_empty , //空标志 usb_slcs , //FIFO使能标志 usb_slwr , //FIFO写触发标志 ...

2018-12-25 17:39:31 1766

原创 Altium designer 快捷键清除走线

  在PCB文件中,按下U然后选择要清除的走线内容。比如我们要将PCB走线全部清除,使用U-A快捷键。如果只是要将一个网络的走线清除,使用U-N快捷键。 ...

2018-12-24 22:04:19 18338

原创 FPGA DDR3 Demo的测试和自建仿真平台

 一. Demo的测试:新建完一个DDR3的IP核后,在core的MY_DDR3_example_design的simulation文件夹里面有README.txt README里面会有提示你需要有哪些步骤。 1.打开仿真的工程,然后选择运行tcl脚本tcl scripts   然后点击run一下tcl。2.根据readme的提示,change Directory...

2018-12-20 14:37:14 3929 10

原创 altium designer 画制BGA扇出设置

 FPGA的封装大多数都是以BGA封装为主,所以要画制FPGA的PCB图纸,必须要学会使用BGA封装PCB的画制。BGA封装引脚的引出一般都是通过软件设置BGA扇出规则,然后软件自动生成的布线。 在规则设置中, 1.设置BGA扇出的规则: 只有你设置了规则后,扇出功能才有效。2.放置BGA封装后,鼠标右击,选择器件操作-> 器件操作,选择扇出器件。  扇出这里根据...

2018-12-20 11:17:11 7449

原创 Altera DDR3 IP Core的调用方法

Altera DDR3 IP Core的调用方法FPGA本篇文章介绍一下如何使用Quartusii13 来生成DDR3 IP核的例化模板。1.点击生成IP核 2.选择创建IP核,然后点击next 3.选择DDR3 IP核 4.选择你开发板上DDR3的器件,然后点击Apply 5.设置ddr3 phy setting memory clock ...

2018-12-18 16:49:28 5646 1

原创 为什么STM32的LCD和SRAM共用了FSMC,他们还能不影响的正常工作

之前使用STM32的FSMC时,还没有注意到LCD和SRAM都共用了STM32的FSMC,那为什么他们还能同时不影响的运行呢? 今天看到两个网址才有些明白了。参考网址:1.SRAM的问题 2.FSMC同时驱动LCD与SRAM博主录制的FSMC总结视频:STM32 FSMC总结视频——文鸿开源工作室正文:学了FSMC后,有个疑问,为什么STM32的LCD和SRA...

2018-12-01 15:36:28 6861 3

fpga实现sobel边缘检测modelsim仿真代码

fpga实现sobel边缘检测modelsim仿真代码

2022-03-24

JLINK V8,V9驱动

本资源为JLINK V8 V9 驱动,亲测有效。双击安装,一路next,也可改变安装路径。

2018-11-18

图像数据的显示上位机

本上位机是采用MFC编写,可用于显示位图数据,按下回车键修改图片的尺寸,双击可打开文件,容错范围为3个bit

2018-08-01

树莓派3b+资料

本资源为树莓派3b+资料,内置百度云链接,如果失效,可找我重新发给你

2018-08-01

BamToMif软件

本资源能将图片信息装换为mif文件,用于例化FPGA中的Rom

2018-07-20

Saleae16逻辑分析仪电脑上位机软件

本资源是Saleae16配套的上位机软件,内含三个版本的安装包,可选择性安装

2018-07-20

空空如也

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