VIVADO综合时报错 : has multiple drivers

错误分析：关键词是multiple drivers。同一个变量，在不同的always 或者assign中被赋值，造成冲突。这在Verilog语言中是不被允许的。尤其是在复制一段代码之后，漏掉要修改的变量名，很容易导致这个问题。

不可综合语句——在多个always块中对同一变量赋值

原因探究：寄存器输入端是由触发器组成的，用两个always块这个寄存器进行赋值，无论其中经过了怎样的条件判断，最终结果毫无疑问是将两个相独立的触发信号连在了寄存器的CLK端上，一端口接入两信号，这显然已经不是一个符合标准的数字逻辑电路了。所以这样的语句是无法被综合成电路的。（不同软件的处理似乎不同，quartus2是直接拒绝双always赋值，而有的综合布线软件在警告之后会将两个信号连到一个双端口门上再接入寄存器，这显然会改变程序原有逻辑，画波形图一看就知道了）

赋值规范：
“在描述组合逻辑的always块中使用阻塞赋值，则综合成组合逻辑的电路结构。”
“在描述时序逻辑的always块中使用时序赋值，则综合成时序逻辑的电路结构。”

阻塞与非阻塞赋值的使用原则：
原则1：时序电路建模时，用非阻塞赋值。
原则2：锁存器电路建模时，用非阻塞赋值。
原则3：用always块描述组合逻辑时，采用阻塞赋值。
原则4：在同一个块中描述时序逻辑和组合逻辑的混合逻辑时，用非阻塞赋值。
原则5：同一个always块中只能全用阻塞赋值或者全用非阻塞赋值。
原则6：不能在多个always块中对同一个变量进行赋值。