【UVM实战 ===＞ Episode_2 】~ VIP、VIP的开发、VIP的发布

最新推荐文章于 2023-04-25 17:47:14 发布
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分类专栏： IC设计/验证、FPGA 文章标签： fpga开发 集成测试
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1. 验证IP（VIP）

1.1 什么是VIP？

这里的VIP指的是Verification Intelligent Property，叫做验证IP。
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1.2 使用范围

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1.3 VIP的优势

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1.4 VIP的使用

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1.5 VIP的市场

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1.6 VIP的选择

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1.7 VIP的供应商

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2. VIP的开发

2.1 概述

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2.2 开发阶段

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3. VIP的发布

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IC二舅
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UVM：验证IP（Verification Intellectual Property, VIP）
Starry__的博客
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目录1. 什么是VIP1.1. 应用场景1.2. 供应商2. VIP的特点和优势3. 如何使用VIP3.1. 选择3.2. 集成模块级别子系统级别SoC级别3.3. 跨平台混合仿真4. VIP的开发和发布 验证环境并不是全部由verifier编写的，可以用到很多已经编写好的，复用程度高的验证模板，例如某些agent，而这些模板就是VIP。 1. 什么是VIP VIP可用于植入用户的验证环境中，用于协议标准和接口的连接和检查。 这些VIP除了根据协议等的驱动driver和sequence外，还包括相应的覆盖
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04-25 222
config里面除了放一些common的控制开关和option外，主要提供一些option给不同的user，default可以不开。当然需要一个特殊的控制也可以由user自己来补充对应部分的实现代码。顶层的seq_item里面instance 各个channel的seq_item，filed_assign函数也是报各个channel的集成到seq_item中调用。好了，到这一个完整的vip就都有了，后面我们来看怎么使用，以及好处在什么地方。接着来看config和seq_item部分。
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02-12 1091
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04-25 330
1.思想当然也是vip的思想，只是一般vip的seq_item和protocol都是统一的，或者说是完全一模一样的，像AMBA vip，笔者介绍的这套比较适合用在大量使用同一套自定义的protocol的地方，不同的module，类似的protocol，类似的transaction.完结，后面打算重新开一个专栏，总结一下笔者工作期间遇到的一些典型场景，主要介绍tb的处理方式和用到或者看到的好的方式方法。然后是seq的使用方式，需要主要指定p_sequencer的时候需要传入自己的seq_item。
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08-30
在通用验证平台(UVM, Universal Verification Methodology)中，`UVM_VBT`是一个宏定义，代表"User Verification Build Time"。当设置为`UVM_NONE`时，它意味着在用户构建时间阶段，不启用任何自定义的验证构建工具或配置。这通常用于简化配置，避免额外的验证流程，使得环境更易于管理和标准化。 默认情况下，如果`UVM_VBT`未显式设置，它可能会采用系统预设值或某些默认的行为。将`UVM_VBT`设置为`UVM_NONE`可以确保在运行时不依赖于特定的验证构建过程，这对于那些只需要基本UVM功能而不需要复杂定制的项目来说是有意义的。
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