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原创 vivado报错:single value range is not allowed in packed dimension
修改如下:bit[3]取消缩写,使用bit[2:0]即可。
2022-09-19 16:01:56
2299
原创 hdlbits答案:Thermostat、Popcount3、Gatesv、Gatesv100、Mux2to1、Mux2to1v、Mux9to1v、Mux256to1、Mux256to1v、Hadd
hdlbits答案:Thermostat、Popcount3、Gatesv、Gatesv100、Mux2to1、Mux2to1v、Mux9to1v、Mux256to1、Mux256to1v、Hadd
2022-08-08 23:05:45
324
原创 hdlbits答案:Exams/m2014 q4g、Gates、7420、Truthtable1、Mt2015 eq2、Mt2015 q4a、Mt2015 q4b、Mt2015 q4、Ringer
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2022-08-07 14:42:25
447
原创 hdl答案:Adder100i、Bcdadd100、Exams/m2014 q4h、Exams/m2014 q4i、Exams/m2014 q4e、Exams/m2014 q4f
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2022-08-04 00:12:19
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原创 hdl答案:Always( case2、 casez、 nolatches)、Conditional、Reduction、Gates100、Vector100r、Popcount255
hdl答案:Always case2、Always casez、Always nolatches、Conditional、Reduction、Gates100、Vector100r、Popcount255
2022-08-03 23:16:04
239
原创 hdlbits答案:Module cseladd、Module addsub、Alwaysblock1、Alwaysblock2、Always if、Always if2、Always case
hdlbits答案:Module cseladd、Module addsub、Alwaysblock1、Alwaysblock2、Always if、Always if2、Always case。
2022-08-03 10:53:48
269
原创 hdlbits答案:Module、 Module pos、Module name、Module shift、Module shift8、Module add、Module fadd
hdlbits答案:Module、 Module pos、Module name、Module shift、Module shift8、Module add、Module fadd
2022-08-03 00:38:47
856
原创 hdlbits答案:Bugs mux2、Bugs nand3、Gates4、Vector3、Vector4、Vector5
Bugs mux2、Bugs nand3、Gates4,Vector3、Vector4、Vector5几个题目的代码都可以继续优化,主要还是审题要清楚
2022-08-02 10:34:39
1106
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原创 hdlbits答案:Vector0、Vector1、Vector2、Vectorgates
hdlbits答案:Vector0、Vector1,Vector2、Vectorgates 都比较基础和简单,但是有时候简洁性和代码可读性是矛盾的
2022-08-02 00:03:03
184
原创 hdlbits答案:Notgate、Wire decl、The 7458 取消定义中间量,减少代码行数
hdlbits刷题答案:Notgate、 Wire decl、The 7458 取消定义中间量,代码行数减少,但是代码的可读性变差,具体的话仁者见仁智者见智。
2022-08-01 23:49:52
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空空如也
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