xilink Clock Wizad 仿真产生CLK前会有毛刺和延时

最新推荐文章于 2024-04-26 11:32:12 发布

qq_43288607

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文章标签： fpga开发

本文链接：https://blog.csdn.net/qq_43288607/article/details/126103810

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图像中wd是clock wizad产生的时钟，从图像上看会产生一个大约580ns的延时，

FPGA类型 Sparn-6 xc6slx4。

产生延时原因，主要是锁相环导致的。

确定要放弃本次机会？

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qq_43288607

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