AD学习笔记第三章

番茄灭世神

已于 2024-10-03 13:57:05 修改

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分类专栏：硬件开发备忘录文章标签：学习笔记

于 2024-07-26 20:47:34 首次发布

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来源：PN学堂

3-1 层细化原理图设计

学习目标：·子原理图设计,放置port
·放置sheet symbol并关联原理图
·使用sheet entry连接子原理图内的port

这个图标可以放置页面符与图纸输入口

3-2 多通道原理图设计

使用repeat语句进行sheet symbol复制：repeat（名称，序号，复制数量）

添加总线的步骤：

①正常画一个网络

②添加总线bus

③标明总线定义，网络名称[1..x],其中x是指总线分支数量

④添加总线入口

⑤添加两个桥接器件的总线分支网络标签

3-3 使用ROOM完成多通道PCB设计

选中一个完成布局的room，之后步骤：设计->ROOM->拷贝ROOM格式，这样操作不能复制实心区域，但可以复制导线。如果在后面的弹窗中选择复制触碰到Room的所有对象，就可以复制了。

3-4 四层板层叠设计

常用的层叠结构

SIGNAL-GND-POWER-SIGNAL

这种排列方式保证了顶层的较短回地路径，建议主要在顶层堆放元器件以及走线)

SIGNAL-POWER-GND-SIGNAL

和第一种特点相反

SIGNAL-GND-SIGNAL-POWER

上面这个结构可以多加退耦电容来补偿电源层的回地损耗

使用layer stacker manager添加层

设计->层叠管理器

来到这个界面（Ocerlay丝印，Solder阻焊）

取消勾选Stack Symmetry，避免两个新生层只能同类型。

右击Top Layer，选择Inert layer below，选择Plane，这个操作相当于在顶层信号层下添加了两层平面。

内层的铜厚一般选择1/2oz

生成之后双击底层层叠栏修改名称，双击PCB层选择网络。

注意要在这一层修改网络！

ZAI

在层叠管理器界面选择工具可以找到图层堆栈可视化器。

3-5 差分与等长布线

本课目标：

放置差分对

或者

效果

在PCB绘制差分走线

在这里暂时关掉了实时DRC

PCB差分走线规则设置

差分走线的最高要求是两条线的对低阻抗近似相等！

设置的一般约束规则如下

把两条线拉到等长

IC引脚附近的走线可能需要走最小间距（GAP）或者调整线宽

panels->pcb

这个面板看布线的相关参数

再通过蛇形走线进行等长调节，这里我们只调节较短的一根，所以使用网络等长调节

选中蛇形走线目标和区域，按下tab调节参数，From Net栏目选择等长的目标网络，下面的Style选择线形，Miter参数控制圆弧的比例（建议50%）

最后效果

3-6 使用工具计算传输线阻抗

课程内容

传输线阻抗的影响因素

假设地平面完整，那么主要因素有线宽、绝缘层厚度、绝缘层介电常数。

分析刨面图，完整地平面与铜皮导线之间形成了电容，利用高中物理知识可以近似计算容值

其中，ϵ 是介质的介电常数，对于真空，ϵ=ϵ0（真空中的介电常数）；对于其他介质，ϵ 是相对介电常数与 ϵ0 的乘积；S 是电容器两极板正对面积，单位是平方米（m2）；k 是静电力常量，但在电容公式中通常被吸收进介电常数中，不单独出现（此处为说明公式的来源而提及）；d 是电容器两极板间的距离，单位是米（m）。

铜皮导线根据承载的信号频率可能也会呈现容性或者感性

使用板厂的工具计算线宽

立创EDA软件上有教程

使用Si9000计算传输线阻抗

看视频

计算差分线的阻抗

同上

3-7 设计一个DCDC降压模块

主要因素

为电路板设计一个DCDC降压Buck电源需要考虑的主要因素如下所示。

功率(峰值功率,平均功率,波动）：因为DCDC芯片大部分具有短路保护功能，峰值与波动异常时可能会触发。

输入输出电压：DCDC芯片有两种输出类型，固定输出与反馈输出，不过一般固定输出芯片内部也集成了反馈电阻；输入电压则是需要引入工程余量。

纹波：可以看工科男孙老师的视频。

工作频率(干扰)：同上，这里讲的不细。

基本结构

DCDC降压电路基本结构:控制器芯片,电感,MOS管（下图中的开关）,肖特基二极管,反馈回路（图中没画）；另外图中的电阻代表负载。

基本原理

DCDC降压电路基本原理是利用电感上的电流不突变,电容的储能作用,以及二极管续流实现的功率信号回路。在零状态响应（仅有VCC输入，储能原件没有工作）条件下，MOS管导通，电感接入VCC，因为电感有抑制电流突变的作用，后端电容电压缓慢地攀升至预输出值，反馈电路会将这一“信息”反馈给芯片，芯片此刻会断开mos管开关电路；之后电感存储的磁场能量会缓慢地释放，通过快恢复二极管三者形成回路，随着储能的不断消耗，当电压小于预输出值时，芯片会再次将mos管开关电路恢复导通。从这个过程我们也可以推断出来DCDC电路无法避免地会产生纹波，只有大小的差异。电感的体积一般与两个因素相关，后端负载的所需功率越大电感就越大，流通信号频率越低电感越大。