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原创 从新出发进入RAMP领域

如下图示,vco校准和范围,在调谐中VCO会出现锁定调谐范围以及vco自身范围两个概念,调谐范围是指在pll依旧锁定过程中vco可以输出的范围,vco自身范围是指vco在设计pll环路中配合pll鉴相器后可调谐的实际范围此范围为pll电可调谐范围略小于VCO实际范围(一般会有10%的余量),它和vco锁定可调谐范围没有直接关系需要按实际设计判断,一般锁定可调谐范围小于等于电可调谐范围小于vco器件范围。需要在状态机的每个周期内配置ramp的分数分子的增量,相位检测器的周期,以及。从寄存器的配置来看;

2023-12-19 14:30:54 423

原创 书接上回PLL1可行方案试行

低杂散锁相环,宽频锁相环,低小数杂散

2023-05-19 11:10:18 235 2

原创 晶振自校准老化以及温补可操作性指南

晶振稳定度,频率稳定度,老化补偿,温飘补偿,AFC

2023-05-10 13:19:08 944

原创 锁相环相关知识整理

相噪原理,锁相环,PLL电源管理和滤波,参考输入拓扑,混频相噪

2023-05-05 11:25:23 2119

原创 锁相环低杂散快锁定优相噪猜想之进阶版

低相噪,低杂散,快锁,锁相环

2023-04-27 13:37:10 304 3

原创 混频锁相环相关拓扑,性能以及错锁问题梳理

DS、PLL、DDS 三种主流频率合成技术DS、PLL、DDS 三种主流频率合成技术。频率综合器的方案设计是根据技术指标完成的,性能优异的频率综合器对各项技术指标都有较高的要求,因此主流的频率综合器设计采用混合式频率合成技术。下面介绍常用的频率扩展方案、小步进方案和低相位噪声方案

2023-04-20 14:52:36 1023

原创 锁相环(PLL)低杂散方案设想

锁相环(PLL)低杂散方案设想初始版本

2023-03-14 16:24:10 1010 1

原创 LDO重要指标评估

LDO相关知识梳理和设计参考

2023-03-14 15:48:41 591

原创 锁相环相噪和供电设计参考

锁相环设计需要时钟评估和电源供电评估

2023-03-14 15:41:24 1444 1

低小数杂散可行方案实行设计

低小数杂散,宽频带,极小拓扑,低功耗。锁相环

2023-05-19

锁相环低杂散快锁定优相噪猜想之进阶版

一版的初步设想方案经过官方双demo的任意随机频点验证和在版实验目前已经确定为可行方案,小数杂散可以通过相关方法进行平滑展现出较为光滑的相噪曲线。

2023-04-27

混频锁相环,架构拓扑研究整理

混频锁相环,架构拓扑研究整理,以及错锁和DDS相关问题整理

2023-04-20

锁相环(PLL)低杂散设想

锁相环(PLL)低杂散设想和相关验证。

2023-03-14

LDO设计参考和资料梳理

LDO重要设计指标计算和理解进行梳理和参考归纳

2023-03-14

锁相环相噪设计参考和电源供电设计

锁相环相噪设计参考和电源供电设计相关资料整理

2023-03-14

锁相环资源大合集.zip

锁相环PLL资源大合集,包括架构理论和实践各方面

2021-05-21

确定总体半中频杂散指标和为LTE接收机选择RF混频器

来源于经典的3GPP协议,进行扩展,同过LTE协议分析射频链路的杂散指标和链路预算方面的指标要求以及指标之间的关系分析。确定总体半中频杂散指标和为LTE接收机选择RF混频器,学习杂散分析。

2018-04-02

开关稳压电源的设计与应用

开关稳压电源的设计与应用-长谷川著作。日本实验图解教程。

2018-04-02

分析、优化和消除带 VCO 的锁相环在高达 13.6 GHz 处的整数边界杂散

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2018-04-02

射频电路工程设计

李缉熙的射频电路工程设计学习S参数必备的参考佳作。实验加教学。

2018-04-02

空空如也

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