risc-v指令集

最新推荐文章于 2024-05-24 14:12:05 发布
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RISC-V指令集

R TYPE

在这里插入图片描述

ADD
ADD rd, rs1, rs2 //x[rd] = x[rs1] + x[rs2]
SUB
SUB rd, rs1, rs2 //x[rd] = x[rs1] - x[rs2]
SLL
SLL rd, rs1, rs2 //x[rd] = x[rs1] << x[rs2]
SLT
SLT rd, rs1, rs2 //x[rd] = signed x[rs1] < x[rs2]
SLTU
SLTU rd, rs1, rs2 //x[rd] = unsigned x[rs1] <  x[rs2]
XOR
XOR rd, rs1, rs2 //x[rd] = x[rs1] ^ x[rs2]
SRL
SRL rd, rs1, rs2 //x[rd] = x[rs1] >> x[rs2]
SRA
SRA rd, rs1, rs2 //x[rd] = x[rs1] >>> x[rs2]
OR
OR rd, rs1, rs2 //x[rd] = x[rs1] | x[rs2]
AND
AND rd, rs1, rs2 //x[rd] = x[rs1] & x[rs2]

I TYPE

在这里插入图片描述

ADDI
ADDI rd, rs1, immediate//x[rd] = x[rs1] + x[rs2]
SLTI
SLT rd, rs1, immediate//x[rd] = signed x[rs1] < x[rs2]
SLTIU
SLTIU rd, rs1, immediate//x[rd] = unsigned x[rs1] <  x[rs2]
XORI
XORI rd, rs1, immediate//x[rd] = x[rs1] ^ x[rs2]
ORI
ORI rd, rs1, immediate//x[rd] = x[rs1] | x[rs2]
ANDI
ANDI rd, rs1, immediate//x[rd] = x[rs1] & x[rs2]
SLLI
SLLI rd, rs1, shamt//x[rd] = x[rs1] << shamt
SRLI
SRLI rd, rs1, shamt//x[rd] = x[rs1] >> shamt
SRAI
SRAI rd, rs1, shamt//x[rd] = x[rs1] >>> shamt

I_L TYPE

在这里插入图片描述

LB

该指令是从有效地址中读取一个字节(byte)，经符号位扩展后写入rd寄存器。

LB rd，immediate(rs1) //x[rd] = sext ( M [x[rs1] + sext(immediate) ] [31:0] )
LH

该指令是从有效地址中读取两个字节(halfword)，经符号位扩展后写入rd寄存器。

LH rd，immediate(rs1) //x[rd] = sext ( M [x[rs1] + sext(immediate) ] [31:0] )
LW

该指令是从有效地址中读取四个字节(word)，经符号位扩展后写入rd寄存器。

LW rd，immediate(rs1) //x[rd] = sext ( M [x[rs1] + sext(immediate) ] [31:0] )
LBU

该指令是从有效地址中读取一个字节(byte)，经零扩展后写入rd寄存器。

LBU rd，immediate(rs1) //x[rd] = sext ( M [x[rs1] + sext(immediate) ] [31:0] )
LHU

该指令是从有效地址中读取两个字节(halfword)，经零扩展后写入rd寄存器。

LHU rd，immediate(rs1) //x[rd] = sext ( M [x[rs1] + sext(immediate) ] [31:0] )

S TYPE

在这里插入图片描述

SB
SB rs2，immediate(rs1) //M [x[rs1] + sext(immediate) ] =x[rs2][7:0]
SH
SH rs2，immediate(rs1) //M [x[rs1] + sext(immediate) ] =x[rs2][15:0]
SW
SW rs2，immediate(rs1) //M [x[rs1] + sext(immediate) ] =x[rs2][31:0]

B TYPE

在这里插入图片描述

BEQ
BEQ rs1，rs2，immediate // if (rs1 == rs2)   pc += sext(immediate )
BNE
BNE rs1，rs2，immediate // if (rs1 != rs2)   pc += sext(immediate )
BLT
BLT rs1，rs2，immediate // if (rs1 < rs2)   pc += sext(immediate )
BGE
BGE rs1，rs2，immediate // if (rs1 >= rs2)   pc += sext(immediate )
BLTU
BLTU rs1，rs2，immediate // if (unsigned rs1 <unsigned rs2)   pc += sext(immediate )
BGEU
BGEU rs1，rs2，immediate // if (unsigned rs1 >= unsigned rs2)   pc += sext(immediate )

J TYPE

在这里插入图片描述

JAL
JAL rd, immediate//x[rd] = pc+4; pc += sext(immediate)
JALR
JALR rd, immediate(rs1)//t = pc + 4;  pc = (x[rs1]+sext(immediate)) & 0xffff_fffe;  x[rd]=t

U TYPE

在这里插入图片描述

LUI
LUI rd，immediate //x[rd] = sext(immediate[31:12] << 12)
AUIPC
AUIPC rd，immediate //x[rd] = pc + sext(immediate[31:12] << 12)
sinat_39901027
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RISC-V学习-第一篇[指令类型]
qq_44719402的博客
01-24 4170
本文是RVSC-V处理器学习的第一篇文章，对RV32IMAFDC指令集的学习笔记。 运算指令 立即数运算指令 addi rd,rs1,imm[11:0] 功能 1.将rs1与12位立即数（进行符号位扩展）相加，并将结果存到rd寄存器中去，如果结果溢出，舍弃溢出位，不做处理，保留低32位结果 2.addi rd,rs1,0指将rs1寄存器中的值存入rd中去 为什么没有立即数减法操作？ 因为addi运算是带符号位进行运算的，可以用addi rd,rs1,-10实现rd=rs1-10功能 寄存器运算指令 add
RISC-V 指令集介绍
qq_57502075的博客
07-31 9513
rs1 (Source Register 1)是第一个源操作数寄存器，占了5bit，在指令的15-19bit；rs1 (Source Register 1)是第一个源操作数寄存器，占了5bit，在指令的15-19bit；rs2 (Source Register 2)是第二个源操作数寄存器，占了5bit，在指令的25-31bit。rs2 (Source Register 2)是第二个源操作数寄存器，占了5bit，在指令的25-31bit。
risc-v指令集手册（非特权架构）- RV32I基本整数指令集V2.1（已批准）
baidu_19375199的博客
05-16 3557
RV32I旨在构成一个编译器目标并支持现代操作系统环境。ISA还旨在减少在最小实现中所需的硬件。RV32I包含40条独特的指令，然而一个简单的实现可能会使用一条总是产生陷阱的单个SYSTEM硬件指令来涵盖ECALL/EBREAK指令，同时也可能将FENCE指令实现为NOP，从而将基本指令数减少到38条。RV32I几乎可以模拟任何其他ISA扩展（A扩展除外，A扩展需要原子性的附加硬件支持）。实际上，包含机器模式特权架构的硬件实现也需要6条CSR指令。
RISC-V精简指令集（RISC）介绍
最新发布
MHD0815的博客
05-24 1645
需要注意的是，RISC-V指令集是可扩展的，可以根据需求进行自定义和扩展，以满足特定的应用场景。此外，RISC-V指令集还包括其他类型的指令，如乘法、除法、移位等，这些指令在RISC-V的不同扩展集中定义，可以根据应用程序的需要选择包含相应的扩展。RISC-V指令集还包括更多的指令和功能，如乘法、除法、原子操作等，这些通常在RISC-V的扩展指令集中定义。由于我无法直接提供官方网址的链接，但您可以在网上搜索“RISC-V 官方文档”或“RISC-V 指令集手册”等关键词，以获取更详细和准确的信息。
RISC-V知识总结 —— 指令集
weixin_65190179的博客
02-23 2981
R型指令通过提供一系列富有表现力的算术和逻辑操作，是RISC-V架构中实现高效数据处理的基础。这些指令的设计充分利用了处理器内部寄存器的高速访问能力，使得RISC-V处理器能够快速执行复杂的数值和逻辑计算，支撑起各种计算密集型应用的需求。I型指令通过结合寄存器操作和立即数操作，为RISC-V提供了灵活的数据处理能力。这包括直接的算术和逻辑操作，以及支持高效的内存访问和简单的条件处理。立即数的使用极大地增强了指令的表达能力，使得程序能够直接编码常数值和偏移量，从而简化代码并提高执行效率。将。
RISC-V学习笔记（2）
夏风喃喃的博客
07-14 7419
第二章 指令：计算机的语言
RISC-V 指令集手册
03-16
RISC-V 指令集手册 卷1：用户级指令集体系结构（User-Level ISA） 2.1 版 中文版 附：下载链接 https://knowledge.fpga-china.com/uploads/20210930/101f15469f946e18d34a9f97664f1f7b.pdf
RISC-V 指令集手册-v2.1中文版.pdf
01-26
riscv-spec-v2.1中文版 翻译很准确
riscv-fs：F＃RISC-V指令集正式规范
02-03
**RISC-V指令集介绍** RISC-V（Reduced Instruction Set Computer - Version Five）是一种开放源码的指令集架构（ISA），由加州大学伯克利分校于2010年发起，旨在创建一个简单、可扩展且高效的新一代处理器设计标准...
riscv-spec-v2.1中文版
10-09
RISC-V指令集体系结构手册，是EETOP网友：要你命3000（论坛username）,花费了大量时间，翻译的最新的RISC-V体系结构手册，提供给大家学习使用！
21｜RISC-V指令精讲（六）：加载指令实现与调试
sucaiwa的博客
03-03 3491
你好，我是LMOS。之前我们已经学过了RISC-V中的算术指令、逻辑指令、原子指令。这些指令主要的操作对象是寄存器，即对寄存器中的数据进行加工，这是RISC体系的重要特性。但你是否想过寄存器中的数据从哪里来呢？答案是从内存中来，经过存储指令加载到寄存器当中。RISC-V是一个典型的加载储存体系结构，这种体系类型的CPU，只有加载与储存指令可以访问内存，运算指令不能访问内存。这节课我们就来学习一下RISC-V的加载指令。顾名思义，加载指令就是从一个地址指向的内存单元中，加载数据到一个寄存器中。
RISC-V常用指令学习笔记
JIUMAO1128的博客
11-13 5833
R-type,S-type,I-type,B-type,J-type,乘除法指令介绍
RISC-V指令集手册第二章-RV32I
Mr_dn的博客
06-25 923
RISC-V指令集手册学习笔记，其中部分参考来自翻译作者：要你命 3000
riscv指令集
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05-25 4526
指令大全
RISC-V 架构指令集手册 第一册 无特权指令集 中文翻译
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02-01 6284
RISC-V 手册页，翻译完了的熟肉好吃
risc_v 汇编指令（1）
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05-27 3237
bgtz： -用法：bgtz rs,offset；作用：if rs > 0 then branch blez： -用法：blez rs,offset；作用：if rs <= 0 then branch bne： -用法：bne rs,rt,offset；作用:if rs != rt then branch beq： -用法：beq rs,rt,offset；作用：if rs = rt then branch, 将地址为rs的通用寄存器的值与地址为rt的通用寄存器的值进行比较，如果..

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