亚稳态测试电路 下图所描述的测试电路可以用来确定触发器的亚稳态特征。下图给了一个异步输入“async_in”的触发器“FFA”,再由时钟“clk”的上升沿触发。下图中所示的触发器“FFB”和“FFC”都在时钟下降沿触发,这样做是为了捕捉FFA的亚稳态事件。 当两个互补的信号分别传递到“FFB”和“FFC”的输入时,无论“FFA”什么时候出现亚稳态事件,同或门的输出都会变成高电平。在触发器"FFD"输出端捕捉到高电平就表明已经检测到亚稳态事件。 测试电路中的时序如下 参考自 《硬件架构的艺术》