VHDL中assert是什么

最新推荐文章于 2023-03-16 17:13:54 发布

linghu__chong

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  VHDL中 
 assert是什么？ 

 
 解：assert是一种代码机的调试手段，当v2<v1时，说明出错。出错后，一般进行错误报告，并根据错误的等级继续或者终止仿真。这里是error，出错仿真将会终止。 

 
 assert一般被中和软件自动忽略，他们不可能生成实际电路，只是一种调试手段。 

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VHDL中assert是什么

VHDL中assert是什么？解：assert是一种代码机的调试手段，当v2assert一般被中和软件自动忽略，他们不可能生成实际电路，只是一种调试手段。
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