FPGA设计入门-----1位全加器的设计

最新推荐文章于 2023-04-10 22:33:41 发布
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文章标签： fpga开发
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本文链接：https://blog.csdn.net/w_pig/article/details/129773613
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本文介绍了FPGA设计的基础，通过QuartusII设计了一个1位全加器。首先，选择了EP4CE11529C7作为目标芯片并创建了原理图文件。接着，详细说明了如何输入半加器的原理图，并进行了编译和设置为可调用元件。然后进行了半加器的仿真，设置输入波形并观察结果。在验证逻辑关系正确后，设计了全加器的顶层文件，将其设置为顶层项目并编译。最后，介绍了如何进行硬件测试，包括引脚绑定、硬件下载和在实际电路中的测试，成功实现了1位全加器的功能。
摘要由CSDN通过智能技术生成

一、准备工作
新建工程
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选择目标芯片：cycloneIVE系列的EP4CE11529C7
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新建原理图文件
打开QuartusII,选菜单“File”一“New”，在弹出的“New-”对话框中选择“ Design Files” 的原理图文件编辑输入项“Block block diagram/scchematic File"
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在编辑窗中调入元件，完成半加器的原理图输入
从“ Symbol”窗中选择需要的符号，或者直接在“name”文本框中键入元件名，如“and2”为2输入与门，点OK按

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w_pig
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本次实验还是比较简单的，让我们对quartus代码的编写和仿真实现和全加器的原理更加熟悉。为之后的学习打下一定的基础。参考文章：https://blog.csdn.net/molongqishi/article/details/129678242。
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