NAND VT曲线

VT曲线

  • VT曲线是CELL导通电压概率密度曲线
    CELL被编程到1个状态后,导通电压呈正太分布
    也可理解为注入到浮删电子数量呈正太分布
    因为量子效应,不可能精确控制每种状态,每次注入相同数量电子
    在这里插入图片描述
    Q&A:

    • 为什么Vread不在波峰处呢?
      因为VT曲线是概率密度分布曲线,波峰两侧都有可能对应到该状态导通电压
      以波峰坐在位置为Vread,分布在左右两侧的电压就会得到不同结果
  • 读取数据中心电压:正太分布之间波谷所在位置电压
    波谷所在位置,是CELL编程后,最不可能分布的电压位置

  • VT曲线状态之间分布的越远,发生误判的概率越小

  • 当CELL处于擦除状态时,可以把CELL当作一个普通MOS
    只需要在栅极加较小电压就能使MOS管导通
    当CELL处于编程状态时,就是把不同数量电子注入到了MOS浮删,从而在衬底到浮删之间形成一个电场,为了导通MOS管,需要在栅极加更大的电压克服这个衬底指向浮删的电场
    往浮删注入越多的电子,衬底到浮删形成的电场越强,导致需要在MOS栅极需要加更大电压才能导通
    所以往浮删注入不同数量的电子,CELL就处在不同的VT曲线状态
    通过判断CELL的导通电压,就可以知道CELL状态

  • 每个编程状态分布是正太分布(normal distribution)
    写入数据后,CELL导通电压最集中分布在正太分布中心位置(波峰)
    实际上不可能控制得这么精确
    只是大部分导通电压都在波峰位置附近

  • 对于1个CELL,多次编程,所有电压的集合,导通电压符合正太分布
    因为同一个CELL,多次编程到同一个状态,每次导通电压不可能控制到完全一致

  • 正常读数据时,NAND会在CELL上加,正太分布波谷所在位置电压,然后通过电流检测,判断CELL状态

  • 读数据出错时
    当使用正太分布波谷电压读到数据出错后
    使用read retry档位,使NAND读取电压偏离中心电压,尝试读回正确数据

  • 当NAND质量较差或使用太久后

    • 1个CELL上,每个状态之间电压分布就会变矮变宽
      因为使用久后,电子行为更随机,更难控制
      导致每个状态分布重叠面积过大,不同状态导通电压交叉
      当在CELL上加理论READ电压,处于READ电压附件的两个编程状态都可能导致CELL导通,这样就不能区分CELL所处的状态,导致数据出错
    • 比如:读取1个WORD LINE上所有CELL
      • 当读取1个WORD LINE上数据时
        根据读取不同page
        给WORD LINE上所有CELL 在栅极同时加相同读取电压
      • 处于相同编程状态的CELL
        每个CELL上导通电压也不一致,有些CELL左偏,有些CELL右偏
      • 处于不同状态的CELL
        每个CELL处于不同编程状态(比如TLC有8个状态)
        • 正常情况下,编程到读取电压左边状态的CELL会导通,编程到读取电压右边状态的CELL不会导通
        • VT曲线左移
          如果当前CELL被编程到理论读取电压右边状态,理论上在CELL加上读取电压后,CELL不会导通。
          但是如果VT曲线左移较多,那么紧挨READ电压右边状态曲线就会和,READ电压产生交叉,此时若CELL小概率被编程到了正太分布的左边部分,那么小于READ电压部分的CELL就导通,导致把编程状态误判为,CELL处在READ电压左边状态
          在这里插入图片描述
        • VT 曲线右移
          如果当前CELL被编程到理论读取电压左边的状态,理论上在CELL加上READ电压后,CELL就会导通。
          但是如果VT曲线右移较多,那么紧挨READ电压左边的状态曲线就会和,READ电压产生交叉,此时若CELL小概率被编程到了正太分布的右边部分,那么大于READ电压部分的CELL就不会导通,导致吧编程状态误判为,CELL出在READ电压右边状态
          在这里插入图片描述
        • VT 曲线重合
          在这里插入图片描述
  • 低温写

    • 低温时,电子能量较低,发生量子隧传概率较低,浮删中捕获到的电子较少
      衬底到浮删电场较小,MOS栅极需要加的正向导通电场(电压)随之变小
      表现为低温下,Vread左移
  • 高温写

    • 高温时,电子能量较高,发生量子隧传概率较高,浮删中捕获到的电子较多
      衬底到浮删电场较强,MOS栅极需要加的正向导通电场(电压)随之变大
      表现为高温下,Vread右移
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引用中提到,NAND闪存的存储结构和操作方式可以从NAND的datasheet中了解到。每种NAND的datasheet都会介绍NAND的组成结构和操作命令。大多数NAND的datasheet在这方面都相似,只是容量大小和读写速度等基本特性有所不同。而引用中提到,NAND闪存相比于NOR闪存有更高的寿命(耐用性)。NAND闪存中每个块的最大擦写次数是一百万次,而NOR闪存的擦写次数是十万次。此外,NAND闪存的块尺寸比NOR器件小8倍,因此每个NAND存储器块在给定时间内的删除次数要少一些。同时,NAND闪存也存在位交换的问题,即某些情况下一个比特位可能会发生反转或被报告反转了。位反转的问题更多见于NAND闪存,因此使用NAND闪存时,建议同时使用错误探测/错误更正(EDC/ECC)算法来保证可靠性。另外,NAND闪存中的坏块是随机分布的,因此在使用NAND器件时需要对介质进行初始化扫描以发现坏块,并将其标记为不可用。与NOR闪存相比,NAND闪存的使用更为复杂,因为需要进行虚拟映射以避免写入坏块。 根据上述引用内容,NAND interleave是指在NAND闪存中进行读写操作时的交叉方式。由于NAND闪存的存储结构和操作方式可以从各种NAND的datasheet中得到,因此具体的NAND interleave方式可能因厂家而异。在实际开发NAND驱动时,需要了解MTD NAND Driver Programming Interface,这可以让我们对MTD有一个直观而又相对具体的认识。但是该文档似乎主要针对NOR闪存,对实际开发NAND驱动的帮助并不是很大。<span class="em">1</span><span class="em">2</span><span class="em">3</span> #### 引用[.reference_title] - *1* *2* *3* [NandFlash驱动移植基础知识](https://blog.csdn.net/qq_41882586/article/details/123375973)[target="_blank" data-report-click={"spm":"1018.2226.3001.9630","extra":{"utm_source":"vip_chatgpt_common_search_pc_result","utm_medium":"distribute.pc_search_result.none-task-cask-2~all~insert_cask~default-1-null.142^v93^chatsearchT3_2"}}] [.reference_item style="max-width: 100%"] [ .reference_list ]
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