quartus频率计时钟设置_基于QuartusII的两种数字频率计的设计与比较

最新推荐文章于 2023-12-27 10:24:38 发布

weixin_39654352

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文章标签： quartus频率计时钟设置

本文链接：https://blog.csdn.net/weixin_39654352/article/details/111844105

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本文探讨了基于Quartus II的两种数字频率计设计方法，分别是原理图输入和VHDL文本输入。在Quartus II上完成编译和仿真，并在ALTERA FPGA器件上进行硬件验证。设计范围1Hz到9999Hz，四种显示。文章还对两种设计方法进行了比较。

摘要由CSDN通过智能技术生成

脑

基于

Quartus

的两种数字频率计的设计与比较

曾永西

(

泉州师范学院

理工学院

福建

泉州

362000

)

【

摘

要

】：

文中提出了基于

Quartus

的两种数字频率计的设计与比较

，

分别采用原理图输入和

VHDL

文本输入两种

设

计

方

法

，

给

出

设

计

的

部

分

代

码

，

在

Quartus

上

对

设

计

进

行

全

程

编

译

和

仿

真

，

并

在

ALTERA

公

司

的

FPGA

器

件

EP1K30TC144-3

上进行硬件下载验证

，

最后对两种设计进行比较

，

发现两种设计方法切实可行

。

【

关键词

】：

Quartus

；

数字频率计

；

VHDL

语言

；

EDA

、

引言

数字频率计是电子设计

、

仪器仪表

、

资源勘测等应用领域不

可缺少的测量仪器

，

不少物理量的测量

，

如振动

、

转速等的测量

都涉及到或可以转化为频率的测量

。

传统的数字频率计一般由

分立元件组合而成

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