Xilinx IP核设计FIR滤波器

最新推荐文章于 2023-08-24 21:11:40 发布
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分类专栏： FPGA 文章标签： Xilinx  FIR滤波器 IP核 Matlab
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本文介绍了使用Xilinx ISE设计FIR滤波器的过程，包括Matlab生成滤波器系数、理解滤波器IP核参数、编写程序以及观察滤波结果。通过设置采样频率和系统时钟，成功实现250Hz和70Hz信号的滤除。
摘要由CSDN通过智能技术生成

Xilinx IP核设计FIR滤波器过程中的问题与思考

最近在使用Xilinx的ISE设计滤波器对采样数据进行处理，在设计过程中逐渐弄明白设计界面的一些频率参数的意义，在此分享设计的经验和本人的一些看法，如有错误欢迎指正。

1、系统功能简述

首先对输入信号进行采样，输入的信号是70Hz和250Hz的FSK调制信号，根据奈奎斯特 采样定理，采样频率Fs需大于500Hz，本人配置ADC采样率为2KHz，足够还原波形。采样后数据变为数字信号，先把数据存入DDR，之后把数据读出，DDR的读写速率均为100MHz，该频率也是系统时钟sCLK的频率。之后对数据进行滤波，分别过滤掉250Hz和70Hz的信号。滤波后的信号经过串口发送至电脑用Matlab进行画图显示波形。

2、Matlab产生滤波器系数

使用Xilinx的滤波器IP核的第一个界面便是要设计滤波器的系数，该系数可使用Matlab产生。
在这里插入图片描述
在Matlab的命令窗口输入fdatool(全称是filter design & analyse)，回车进入滤波器设计界面
在这里插入图片描述
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