ZYNQ实现无DDR启动实现

最新推荐文章于 2024-06-03 09:59:57 发布
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文章标签： zynq no ddr fsbl boot 启动
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版权

1.硬件环境搭建
使用版本vivado2018.2
在配置中，不使能DDR
在这里插入图片描述
生成bit，导入到sdk
2.SDK操作流程
在平台环境中，修改ps7_init.c文件，将ddr相关文件注释掉
在这里插入图片描述
生成bsp后，修改xparameters.h,添加ddr参数配置
在这里插入图片描述
然后，生成fsbl
在fsbl的main.c中，增加XPAR_PS7_DDR_0的条件编译，而这个宏没有定义，相当于注释掉
在这里插入图片描述
然后修改fsbl.h文件
在这里插入图片描述最后修改qspi.c文件
在这里插入图片描述
重新编译即可
3.注意
在其他文章中，提到修改程序运行空间为ram0，这里目前没有修改，是正常的，这里可作为一个参考

weixin_43189165
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zynq无DDR设计参考
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【ZYNQ逻辑】基于 DDR3 的串口传图帧缓存系统设计实现
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06-03 246
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不带DDR的ZYNQ使用OCM加载程序运行的方法
hpf247的博客
12-02 3764
软件版本：Vivado Vitis2019.2 第一步： 在Vivado的ZYNQ Block Design时候不配置DDR 第二步： 在Vitis中： 1、 在Vitis中新建Platform，选择xsa文件： 2、 在xparameters.h中添加DDR的地址空间定义，如下： 3、 修改链接文件，修改每个段都到ram_0，因为ram_1空间全部给到应用程序 4、 修改fsbl工程的main.c，增加XPAR_PS7_DDR_0条件编译 5、 修改fsbl.h，重定义DDR_EN
zyqn 无ddr打印helloworld
weixin_60612482的博客
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建立一个helloworld工程，确保可以打印并可以实现下载到flash断电不丢失 然后取消勾选ddr, ZYNQ 无DDR 启动 1 fsbl_bsp 相关修改 1.1 Translation_table.s 1.2 xil_exception.c 2 fsbl 相关修改 2.1main.c 2.1.1 添加头文件 2.1.2 添加 preload_func 和 copy 函数及一些宏定义等 具体内容如下： 2.1.3 添加 data 拷贝
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标题 "ZynQ PL 读写DDR 实现VGA高清显示(2)" 指向的是在Xilinx ZynQ FPGA平台中，通过处理器系统（PS）与可编程逻辑（PL）之间的交互来实现对DDR内存的读写操作，并通过VGA接口驱动显示器以达到高清显示的目的。...
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01-13 1193
修改FSBL，可以把APP和FSBL编译成一个可执行文件
Xilinx Wiki / Technical Articles Zynq-7000 AP SoC Boot - Booting and Running Without External Memory
爱她就要努力
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https://www.xilinx.com/support/answers/56044.html https://xilinx-wiki.atlassian.net/wiki/spaces/A/pages/18842377/Zynq-7000+AP+SoC+Boot+-+Booting+and+Running+Without+External+Memory+Tech+Tip http://xin...
zynq无DDR使用OCM加载程序运行
nabiaosu8432的博客
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一、使能DDR，但程序不用DDR 赛灵思提供的文档，按照文档进行 链接:https://yun.baidu.com/s/1_tfNnXay524i4u8RS5Rt-Q 密码:nnsa 第八步 改为注释掉FLASH大小选择，均写成128M 就可以成功的OCM加载程序了 二、在硬件中不使能DDR 根据参考 采用的方法是在zynq block design配置时保留ddr，而在程序编...
ZYNQ基本用法------DDR（1）
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PS端对DDR进行读写DDR原理硬件部分1、建立工程2、点击“Create Block Design”，创建一个 Block 设计，也就是图形化设计3、点击“Add IP”快捷图标，搜索ZYNQ，然后双击。4、双击 Block 图中的“processing_system7_0”，配置相关参数1、首先出现的界面是 ZYNQ 硬核的架构图，可以很清楚看到它的结构，可以参考 ug585 文档，里面有对 ZYNQ 的详细介绍。图中绿色部分是可配置模块，可以点击进入相应的编辑界面，当然也可以在左侧的窗口进入编辑。下面
zynq无ddr参考设计
05-12
Zynq无DDR参考设计是指在使用Xilinx Zynq系列SoC芯片设计嵌入式系统时，通过一些异步存储器和缓存控制器的组合，实现没有DDR存储器的设计方案。 这种设计方案的主要优势在于节约成本。在一些嵌入式应用场景中，需要处理的数据量相对较小，因此不需要大量的存储器。此时使用DDR存储器会增加硬件成本和功耗开销，而Zynq无DDR参考设计则可在满足应用需求的同时，以更低的成本实现设计。 但是这种设计方案也受到一些限制。由于异步存储器速度慢，可能会出现访问时间延迟的问题，如果需要处理大量数据时，会限制系统的性能表现。同时，由于缺少大容量的存储器，无法实现复杂的算法和应用场景。 因此，在选择使用Zynq无DDR参考设计时，需要充分考虑应用场景和需求，并进行合理的权衡。需要权衡的因素包括应用程序的数据量、性能需求、GPIO数量等。 总之，Zynq无DDR参考设计是一种可行的设计方案，在一些应用场景下可以发挥优势，但对于某些应用场景，还是需要考虑其他设计方案。
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