FPGA_HDLBits_23_Three modules

Module shift √

翻译:

问题要求:需要实例化三个模块,这三个模块其实就是三个D触发器,同步时钟,组合可以实现打三拍的需求,需要在绿色大箭头的地方声明wire变量

代码如下:(我使用的是按名称的声明方式)

网站提供的解决方案:(网站给出的解决方案用的是按位置的声明方式)

结果如下:

评论
添加红包

请填写红包祝福语或标题

红包个数最小为10个

红包金额最低5元

当前余额3.43前往充值 >
需支付:10.00
成就一亿技术人!
领取后你会自动成为博主和红包主的粉丝 规则
hope_wisdom
发出的红包
实付
使用余额支付
点击重新获取
扫码支付
钱包余额 0

抵扣说明:

1.余额是钱包充值的虚拟货币,按照1:1的比例进行支付金额的抵扣。
2.余额无法直接购买下载,可以购买VIP、付费专栏及课程。

余额充值