Vivado中约束文件没有绑定全部的管脚，导致无法生成比特流文件

于 2024-11-25 16:41:06 发布
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报错信息：

原因1：此种情况发生在对一个工程进行全编译后生成bitstream时，如果没有给工程添加IO约束，那么整个工程生成的bitstream就没有任何意义，所以生成bitstream的时候就会报该错误并生成失败。

原因2：这是因为当有管脚不需要的时候，在xdc文件中加入这几行就可以生成比特流。

#set_property SEVERITY {Warning} [get_drc_checks NSTD-1]
#set_property SEVERITY {Warning} [get_drc_checks RTSTAT-1]
#set_property SEVERITY {Warning} [get_drc_checks UCIO-1]

这是小梅哥的解决方法，我将连接放在这里，大家可以看原文章：

【Vivado常见问题】【DRC NSTD-1 DRC UCIO-1】无法生成bitstream（部分管脚位置或电平未指定） - Vivado软件使用和设置 - 芯路恒电子技术论坛 - Powered by Discuz!

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