IP核使用
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摸鱼的杰德
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AURORA+CHIP2CHIP内回环与外回环总结
摘要:之前写过两篇文章,关于aurora和chip2chip的;这边文章算是加深理解,以前一直没有搞懂内回环应该如何测试,本篇主要对内回环和外回环总结;这个思路应该也适用于Ethernet调试;有些概念需要知道:chip2chip+aurora的使用方法如下:aurora里面包含了transceiver,所以有寄存器可以调loopback:如果需要用到share logic功能,提供连接思路需要理解xilinx chip2chip+aurora example design,如何判断ip成功正常工作:Mas原创 2024-04-29 09:36:16 · 717 阅读 · 0 评论 -
IBERT(二)
摘要: pg173-ibert及ibert测试IBERT(一)介绍了IP的一些配置以及使用,这篇介绍一下实际测试。原创 2023-03-14 22:04:41 · 919 阅读 · 1 评论 -
EMIO与pin连接;GPIO通过EMIO映射到sysfs;FPGA配置方式
摘要:EMIO与pin连接;GPIO通过EMIO映射到sysfs;FPGA配置方式,通过zu67向ku3p下载bit文件原创 2023-02-06 10:17:06 · 1051 阅读 · 0 评论 -
Aurora、Chip2chip、Ethernet(二)
摘要:Aurora、Chip2chip、Ethernet共用一个gt时钟的正确的解决方案以及在实际实现以及在实现过程中遇到的其它的问题。原创 2023-01-28 16:00:54 · 1439 阅读 · 0 评论 -
Aurora、Chip2chip、Ethernet(一)
摘要:之前的文章对aurora、chip2chip以及Ethernet这三个IP都进行介绍、仿真和使用说明。但是在实际使用中一定没有那么简单,在复杂联合使用的情况下,肯定会碰到各种各样的问题。此系列文章主要说明如何解决联合使用情况下碰到的一系列问题。原创 2023-01-28 14:39:12 · 1750 阅读 · 3 评论 -
Aurora 和 ChipToChip IP(二)
摘要:对Aurora和chiptochip的ip 核进行介绍,并对两个IP分别进行仿真。写的不一定全对,自行斟酌。原创 2022-11-03 15:41:22 · 2416 阅读 · 10 评论 -
Aurora 和 ChipToChip IP(一)
摘要:对Aurora和chiptochip的ip 核进行介绍,并对两个IP分别进行仿真。原创 2022-10-25 17:04:21 · 2318 阅读 · 0 评论 -
RAM IP核的使用
摘要:FPGA中的RAM有单端口、双端口和伪双端口之分,本文使用伪双端口。原创 2022-07-24 08:45:46 · 795 阅读 · 0 评论 -
DDR-rd-wr-capture(一)
摘要:简单的记录一下自己调试DDR读、写capture的内容原创 2022-07-17 12:39:14 · 230 阅读 · 0 评论 -
2022-5-11-在Vivado中用tcl对寄存器进行读写操作 & JTAG to AXI Master IP的使用
摘要:首先这个工程必须支持用tcl读写寄存器,然后文章给出如何使用tcl读写寄存器首先需要定义这些,把下列代码写进文本文件,例如:vernon_lib.tcl# AXI or AXI Lite access via JTAGset addr_version A0262000;set addr_scratch A0263ffc;# ------------------------------------------------------------------原创 2022-05-14 09:19:13 · 2312 阅读 · 0 评论 -
AXI DMA
摘要:了解AXI DMA原创 2022-05-23 13:20:14 · 1220 阅读 · 0 评论 -
ROM IP用法
摘要:熟悉一下ROM IP的用法,在测试rf data converter的时候作为DAC的输入。原创 2022-05-05 15:47:16 · 339 阅读 · 0 评论 -
ILA的使用
摘要:介绍ILA必须掌握的两种使用,ILA的高级使用Capture Control和Advanced Trigger(懂了后再来补)原创 2022-04-28 17:19:12 · 5750 阅读 · 0 评论 -
10G/25G Ethernet Subsystem(二)(外回环)
摘要: 仅仅使用这个IP核,在硬件上实现外回环测试。IP参数设置与内回坏一样原创 2021-12-30 10:23:09 · 2474 阅读 · 6 评论 -
10G/25G Ethernet Subsystem(一)(内回环)
在Xilinx官方文档中(PG210-25G-ethernet)找到自己要的信息,我这里几乎没有去动IP核什么参数,主要是通过这个IP去完成内回环以及外回环的仿真以及上板调试(另一篇文章),通过实现这个去了解整个FPGA开发流程。原创 2021-12-16 10:51:31 · 6530 阅读 · 32 评论 -
IBERT(一)
摘要: pg173-ibert、IBERT Ultrascale GTY(IP核)原创 2022-03-08 14:51:06 · 2903 阅读 · 0 评论