2017年07月_yundanfengqing_nuc

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原创 matlab保存数据到txt文档

a= [239 254 1 6 0 0 0 0 127 127 127 1 0 34 18 26 43 176 0 0 0 0 0 0 55 46 0 0 0 0 0 0 66 72 0 0 0 0 0 0 76 203 0 0 0 0 0 0 86 137 0 0 0 0 0 0 95 89 0 0 0 0 0 0 103 19 0 0 0 0 0 0 109 150 0 0 0 0 0 0

2017-07-28 15:31:32 3921

原创 FPGA中常用写法

（1）rs232中判断数据起始位always @(posedge clk)beginif(cnt_start==300) %300是通过FPGA在线测试查看rx持续为高的大概时间确定的process_en else if(rx)cnt_start elsecnt_start end//always @(posedge clk)if(proc

2017-07-20 18:20:32 1109

转载 EbNo（EbN0）和SNR

转自：http://blog.csdn.net/qsj8362234/article/details/7705244Q1：为什么要将EbNo转换为SNR呢？ A1：因为要加入高斯白噪声信道，高斯白噪声信道的噪声参数是与SNR直接相关的，所以要将EbNo转换为SNR。 Q2：为什么仿真要用EbNo，而不用SNR呢？ A1：因为用EbNo可以直观的看到系统

2017-07-11 17:07:21 908

转载误差向量幅度（EVM）

转自：http://blog.sina.com.cn/s/blog_6c46cb860100otm3.html误差向量幅度（EVM）：误差向量（包括幅度和相位的矢量）是在一个给定时刻理想无误差基准信号与实际发射信号的向量差。Error Vector MagnitudeEVM是衡量一个RF系统总体质量指标，定义为信号星座图上测量信号与理想信号之间的误差，它用来表示发射器的调制精度，调制解调器

2017-07-11 11:28:42 48679

原创 FMT调制解调

一、FMT调制

2017-07-10 15:23:36 614

转载 Xilinx 主流芯片选型指导

转自：http://blog.sina.com.cn/s/blog_77b6c65d010148a8.html在采用FPGA电路设计中，首先要进行芯片选型。而芯片选型都是根据你的设计需求来找器件，不确定需求的话就无从谈起选型。需求可能涉及以下几个方面：1.时钟速度（逻辑时钟、IO时钟等），不同Family能达到的速度不同2.时钟数量，不同Family的时钟资源不同

2017-07-07 15:22:54 4063

原创上线调试和下线调试

1、上线调试上线调试最为常见的方法就是将程序下载到开发板，然后再观察开发板的结果是否与预期一样板，如发出“哔哔哔”声的程序，下去开发板后蜂鸣器发出“哔哔哔”的话，那么程序就合格。2、下线调试所谓下线调试就是在没有开发板的情况下，利用模拟环境取得假想结果，假想结果再经由大脑进一步脑补（反映）实际的情况。

2017-07-05 14:43:57 1059

Vivaod FFT IP核调试例子

Vivaod FFT IP核调试例子，对8点[0 1 2 3 4 5 6 7]进行FFT 变换，Vivado仿真结果和matlab仿真结果一致。

2023-04-11

SI5341.pdf

LOW-JITTER, 10-OUTPUT, ANY-FREQUENCY, ANY-OUTPUT CLOCK GENERATOR

2020-10-14

特权FPGA VIP视频图像开发套件例程详解2——DDR2控制器读写测试.pdf

本实例对 Altera 提供的 DDR2 控制器 IP 核模块进行操作，每 1.78 秒执行一次 DDR2 的写入和读出操作。先是从 0 地址开始遍历写 256*64bits 数据到 DDR2 的地址 0-1023 中；在执行完写入后，执行一次相同地址的读操作，将读出的 256*64bits 数据写入到片内 RAM 中。

2020-10-14

top_rs.zip

本工程实现了RS（255,223）的编码功能，并对两组数进行了RS编码的仿真验证，最终经matlab仿真验证，结果一致。

2020-06-23

DDR3读写时序分析

对DDR3的User Interface的Command时序以及读写时序进行了详细分析

2018-10-09

空空如也

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