AXI Memory Mapped To PCI Express手册学习笔记

最新推荐文章于 2024-03-28 09:34:31 发布

傻智智爱吃糖

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文章标签： fpga开发 PCIE

本文链接：https://blog.csdn.net/zhangkui469226425/article/details/128484974

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一、其它笔记

1，名词解释

名词	说明
MSI	Messaged Signaled Interrupt
TLP	Transaction Layer Packets
BAR	Base Address Registers

2，Memory Map。基地址的值可通过C_BASEADDR配置
在这里插入图片描述

二、地址

1，ip内部分两个BARS( Base Address Registers)，分别是 PCIE_BARS 和 AXI_BARS，二者都有自己的寄存器map，映射关系可配

在这里插入图片描述

2，

在这里插入图片描述

三、中断

	1，中断分为3种，分别是：Local, MSI and Legacy Interrupts 
	
	2，ip核中断端口定义：

在这里插入图片描述

MSI_Vector_Num(PCIE核的输入)：请求一个MSI中断时的矢量值，上位机根据这个矢量值来判断产生的是什么中断，msi最大支持32个矢量中断。
问题：RP端怎么获取EP端发过来的这个MSI_Vector_Num？

	3，

在这里插入图片描述

4，MSI和Legacy中断只能从EP发往RP。
问题：那RP能给EP发中断吗？怎么发？
在这里插入图片描述

5，0x13C寄存器写32’hFFF20FFF，最终读出来为0x1FF20FE7

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05-09

6061

官方手册地址链接：https://china.xilinx.com/support/documentation/ip_documentation/axi_pcie/v2_8/pg055-axi-bridge-pcie.pdf

Axi memory mapped to PCI Express、uart和gpio IP核在vivado中的应用

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07-02

2660

Axi memory mapped to PCI Express IP核核uart核在vivado中的应用我的项目中要应用的是，PCIE连接8的uart，用的FPGA是XC7K325TFFG900。先了解了一下几个PCIE IP核，网上这样说（链接: link）： 7 Series Integrated Block for PCI Express，把PCIe的TLP包转换成AXI Stream信号，然后对TLP包进行解析，从而实现PCIe的通信接口；常用的应用解决方案可以采用移植Riffa，结合Riff

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2150

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03-21

1841

本文主要描述了AXI Memory Mapped to PCI Express的基本功能

AXI Memory Mapped to PCI Express 学习笔记（四）——仿真设计

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03-28

1338

本文包含有关Vivado Design Suite中对AXI Memory Mapped to PCI Express core进行仿真的示例设计信息。

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05-20

1550

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黑客三遍猪

08-28

6080

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xdma是一种基于PCIe总线的数据传输技术，在Xilinx Kintex Ultrascale系列FPGA上实现了AXI4-Stream接口形式下的性能测试演示。AXI Memory Map和AXI Stream是xdma中的两种接口形式。 AXI Memory Map接口是一种基于内存映射的接口，它使用一组地址和数据信号进行通信。在xdma中，AXI Memory Map接口主要用于配置和控制寄存器的访问，例如写入地址（Write Address）、写有效（Write Valid）等。通过这些寄存器的设置，可以实现通道的选择、中断的使能和轮询模式的设置等功能。 AXI Stream接口是一种基于流式数据传输的接口，它使用一组数据信号进行通信。在xdma中，AXI Stream接口主要用于数据的传输，包括C2H（从主机到FPGA）和H2C（从FPGA到主机）两个方向的数据传输。通过这种接口形式，可以实现高速数据传输，满足对性能要求较高的应用需求。