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原创 二进制和格雷码转换方法及程序
进制转格雷码:简单来说就是把二进制码右移一位再与二进制异或。assign wr_poi_gray = wr_poi ^ (wr_poi>>1); //produce wr pointer gray code;格雷码转二进制:格雷码转二进制是从左边第二位起,将每位与左边一位二进制码的值异或,作为该位二进制码的值。比如四位的码:bin[3] = gray[3];bin[2] = gray[2]^bin[3];bin[1] = gray[1]^bin[2];bin[0] = gray
2020-10-26 12:50:11 1581 1
原创 FPGA之同步FIFO篇
我想大家都知道,队列是计算机系统中一种比较基本的数据结构。作为队列中的一种,先进先出的FIFO是一种比较常用的存储器单元。FIFO通常有读允许端口、写允许端口、数据输入端口、数据输出端口、FIFO状态端口等信号端口。其中,FIFO状态端口输出当前FIFO的状态——满、未满或空。16*16位FIFO的功能框图如下。其中,clock为系统时钟信号输入,reset为系统复位信号,read为读数据信号允许信号,write为写入FIFO允许信号,fifo_in[15:0]为数据输入,fifo_out[15:0]为数
2020-10-26 12:31:59 709
原创 python 程序员需要掌握的100个模块
本文所列举的这100个模块,是我在工作和学习中用过的或者正在学习的,算是对自己过去12年的学习总结。希望对处在迷茫中的程序员有所帮助。英汉小词典pythoneer - 指所有用python语言开发程序的人pythonista - 意为资深的、追求质量和品味的python开发者在这个列表中,我把模块分成11大类:1. 基础类2. 数据库接口类3. 网络通讯类4. 音像游戏类5. GUI类6. web框架类7. 科学计算类8. 2D/3D类9. 数据处理类10. 机器学习类1
2020-10-21 23:51:08 475
原创 经典解析:《一行Python代码能实现什么》及其解析
逛博客时偶然看到这篇文章,也见识了Python代码简洁、高效的魅力。对几个经典案例产生了兴趣,解读了一下,如下:背景背景是作者在处理头部CT的断层扫描图片时,需要将109张图片数据读出来,组织成一个三维的数据结构,如下:作者在引入numpy和PIL之后的代码如下:data = np.stack([np.array(Image.open('head%d.png'%i)) for i in range(109)], axis=0)其实,可以写成这样:data = list()for i in r
2020-10-20 00:07:55 310
转载 python中yield的用法详解——最简单,最清晰的解释
首先我要吐槽一下,看程序的过程中遇见了yield这个关键字,然后百度的时候,发现没有一个能简单的让我懂的,讲起来真TM的都是头头是道,什么参数,什么传递的,还口口声声说自己的教程是最简单的,最浅显易懂的,我就想问没有有考虑过读者的感受。接下来是正题:首先,如果你还没有对yield有个初步分认识,那么你先把yield看做“return”,这个是直观的,它首先是个return,普通的return是什么意思,就是在程序中返回某个值,返回之后程序就不再往下运行了。看做return之后再把它看做一个是生成器(ge
2020-10-19 19:38:28 267
转载 Python十大技巧语法
Python十大装B语法1. for - else2. 一颗星(*)和两颗星(**)3. 三元表达式4. with - as5. 列表推导式6. 列表索引的各种骚操作7. lambda函数8. yield 以及生成器和迭代器9. 装饰器10. 巧用断言assertPython 是一种代表简单思想的语言,其语法相对简单,很容易上手。不过,如果就此小视 Python 语法的精妙和深邃,那就大错特错了。本文精心筛选了最能展现 Python 语法之精妙的十个知识点,并附上详细的实例代码。如能在实战中融会贯通、灵活
2020-10-19 19:29:41 409 1
转载 FPGA设计基础交流【汇总贴】
【问题1.1】如何知道ddr3里不空,可以读取了?答:DDR3和RAM一样,是一个存储器件,它的每个内部单元都存储了当前的数据状态值。但DDR3和RAM本身,是没有“空”、“存有数据”,“数据满”等概念的。只要给地址,它就会把当前地址的数据给到总线上,而且这个地址可以读很多次。在设计的时候,是由设计师用自己写逻辑来判断DDR3是否为空。【问题2】SPI多字节发送是多个字节连在一起发还是分成单字节来进行发送?答:每款芯片的数据手册,都会有时序图的介绍,需要按照芯片数据手册的要求进行通信。每款芯片的要
2020-10-19 18:05:20 418
转载 LVDS 显示屏的两种接口标准:VESA 和 JEIDA;单/双路 LVDS 信号
文章目录一、什么是LVDS?二、LVDS 两种接口标准比较三、单路和双路 LVDS 信号一、什么是LVDS?LVDS,Low Voltage Differential Signaling,低压差分信号,传输速率可达几百Mbps(下文会用到)。二、LVDS 两种接口标准比较这两种接口标准的区别在于:每对低压差分信号上传输的 R、G、B 三色的位数和 HS 、VS、DE 位置不同。8bit 液晶屏需要 4 对差分对传输 R、G、B 三色和 HS 、VS、DE控制信号(1)对应到 VESA 接
2020-10-13 12:22:10 16298 5
转载 最强Verilog例化说明
文章目录Verilog例化说明1.什么是模块例化?为什么要例化?2.实例说明例化方法Verilog例化说明1.什么是模块例化?为什么要例化?模块例化可以理解成模块调用。对于一个FPGA工程,通常是由一个顶层模块与多个功能子模块组成,为了实现顶层模块与子模块的连接,需要进行模块间的例化(或说是调用)。在一个FPGA项目工程中,其输入、输出端口命名通常在设计前期就已确定下来,但会存在一些中间变量,一个工程可能会让不同的工程师在不同的时间段内共同完成,不同的人对于这些变量的命名会有所不同,故例化很有必要。
2020-10-12 10:54:17 3101 1
转载 FPGA内部结构、配置模式
1 FPGA的内部结构主要包括以下5个方面:可编程逻辑门阵列:由最小的逻辑单元LE组成;可编程输入输出单元 IOE:input output element;嵌入式SRAM块:为M4K块,每个SRAM大小为4k,掉电丢失;布线网络;PLL锁相环:最大可倍频至250Mhz基于查找表的FPGA逻辑单元是FPGA的重要组成部分。一个逻辑单元(LE,Logic Element )包含一个4输入的查找表,同时加上一个寄存器。那么它们是如何工作的呢?基于LUT(Look Up Table)和SR
2020-10-09 20:24:20 986
plot_function.zip
2020-02-13
传递函数响应.zip
2020-02-13
EasyX2018春分版软件
2018-04-09
仅5M小巧好用的PDG文件阅读器
2017-09-25
simulink中如何把仿真中实时计算的像素点及对应坐标显示出来,最后应显示一张照片?
2020-08-11
C++字符串处理:为何不能去掉s3=s1;这一句代码
2018-11-29
1020 月饼 ,测试案例有三个不能通过,提示错误,求帮助!
2018-11-22
1013 数素数 测试点4通过不了,请教有何问题
2018-11-21
PAT乙级1079测试点2/3/4提示答案错误,有哪些情况未考虑到?
2018-11-18
1072 开学寄语,AC时三个测试都通不过,提示格式错误,答案错误,求助
2018-11-14
1066 图像过滤,AC时为什么提示超时?
2018-11-12
PAT乙级1059 C语言竞赛 测试点2通过不了,求助呀
2018-11-11
PAT1045运行超时我知道原因,还提示格式错误是哪里有问题
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1034 有理数四则运算 测试点2通过不了,求助
2018-10-31
1070 结绳 代码疑惑,代码意思是一样的呀
2018-10-28
1028 人口普查最后一个测试点通过不了
2018-10-28
1025 反转链表 ,提交没有AC,单独测试倒是可以
2018-10-26
PAT1005 继续(3n+1)猜想,提示Segmentation Fault
2018-10-25
PAT1024提交时出现问题,提示Segmentation Fault。请帮忙解决
2018-10-24
PAT1020月饼,为什么市场需求need每次还都是20 呢?
2018-10-23
PAT1019 数字黑洞 提交时Time Limit Exceeded
2018-10-23
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