基4 SRT除法器

本文详细介绍了基4 SRT除法器的工作原理,包括冗余数字集与冗余度、QDS表的生成、被除数与除数归一化、部分和表示、实时转换、后处理步骤以及Verilog设计。通过归一化、递归求解部分和、实时生成商数等步骤实现除法操作。文章指出,优化QDS表和加速除法仍是挑战,目前的设计存在一些小错误,但整体思路清晰,可供参考。

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目录

一、冗余数字集与冗余度

二、QDS表

三、被除数与除数归一化

四、部分和表示

五、On-the-Fly Conversion

六、后处理

七、Verilog设计


终于有时间来更新基4 SRT算法了,很是抱歉,实在太忙了。

在这之前已经有连续5篇分别对主要概念进行了说明,为了更好的了解,进行了先分后总的介绍,主要在以下五篇:

  1. 冗余数字集与冗余度
  2. Roberson图与overlap
  3. PD图
  4. 预移位与连“符号位”检测
  5. On-the-Fly Conversion

一、冗余数字集与冗余度

基4 SRT算法此处选择冗余数字集为{-2,-1,0,1,2},冗余度为2/3。

参考:

冗余数字集与冗余度:https://zhuanlan.zhihu.com/p/341575538

二、QDS

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