RISC-V又一开源SoC-zqh_riscv

已于 2022-03-20 16:57:40 修改
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分类专栏： 优秀的 Verilog/FPGA开源项目介绍 文章标签： python java 单片机 嵌入式 linux
于 2022-03-02 08:30:00 首次发布
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zqh_riscv是一个开源SoC开发平台，基于RISC-V架构，包含处理器core、cache、总线、中断控制器等组件。支持FPGA原型验证和ASIC综合，采用tilelink总线，提供多种外设IP，如UART、SPI、I2C等。该平台还包含测试用例、调试工具和综合脚本，旨在服务于IOT和嵌入式设备。

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RISC-V又一开源SoC-zqh_riscv

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项目地址：

❝

https://github.com/zhouqinghua/zqh_riscv

介绍

zqh_riscv是一套开源SoC开发平台，核心部分包含处理器core、cache、片内互联总线、中断控制器、memory控制器、片内总线slave接口、片内总线master接口、片内总线device、片外总线device、时钟复位控制器、debug控制器。还包含了SOC功能验证/仿真相关的脚本程序和测试用例。除了可以运行电路仿真，平台还提供了ASIC综合脚本，可以对生成的电路做逻辑综合。

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