【System Verilog and UVM基础入门25】Cadence工具的使用

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Vmanager 自动化仿真管理工具

对于这款工具，笔者用到最多的地方就是写testplan！

没错，根据设计文档(Target Specication)，细分feature list.

对于验证工程师要做的事情，就是验证设计功能的完备性，需要逐一的验证每个feature list.

首先，要做的事情事：打开工具！

>>>vmanager -local &

第一次打开的时间比较长，可以耐心的等等。

图1 Vmanager图形化界面

 

图2 加载PDF文件

为什么要这一步的操作呢？因为我们需要把文档中的功能点都标记出来。这样才能进行下一步的操作。PDF是通过WORD导出PDF格式生成的。

图3 一级标题

BABY_NAME是第一级的标题，表示我们第一个feature list的功能；

图4 二级标题

图5 三级标题 

图6 反标

第一步选中二级标题（细分后的功能点）；第二步：再次细分三级标题；第三步选中PDF文档种的内容（功能描述的文字）。

图7 save

第三步： 三级标题 

第四步反标。

图8 vplanx文件 

到此为止，我们已经完成了文件反标的第一步！

当然还需要保存csv格式的文件；

图9 生成CSV格式文件 

接下来是将CSV格式的文件转换成xlxs格式的文件。 

图10 脚本转换过程

图11 生成好的excel文件

这就是通过Vmanager生成testplan 的标准化步骤。