Vivado link synplify edf 和 xilinx ip或者原语

最新推荐文章于 2024-04-18 19:41:15 发布
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文章标签： fpga开发
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本文详细描述了如何在Vivado中处理XilinxIP和原语，包括使用read_edif导入EDIF文件、添加IP、链接设计并指定顶层和FPGA器件，以及当两者同时存在时如何使用wrapper和处理实例路径的操作过程。还提到了参考资源AMDCustomerCommunity。
摘要由CSDN通过智能技术生成

摘要：Vivado link synplify edf 和 xilinx ip或者原语

如果只有ip的话：

read_edif ./XX.edif

添加IP

link_design -top XX -part XX

write_checkpoint linked.dcp

-part指的是FPGA 器件

-top指的是顶层的名字，乱填会报错

read_edif需要指定edf的路径

如果既有ip，又有原语的话：

先在原语上包一层wrapper，生成dcp

read_edif ./XX.edif

添加IP

link_design -top XX -part XX

read_checkpoint -cell XX ./XX_ooc.dcp

write_checkpoint linked.dcp

read_edif导入顶层edf

-cell 指的是top下例化instance的绝对路径

查看xilinx回复：

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