Verilog中的整型常量表示

最新推荐文章于 2024-05-20 17:26:14 发布

__Heisenberg__

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文章标签： fpga开发

原文链接：https://zhuanlan.zhihu.com/p/72011463#:~:text=%E5%9C%A8Verilog%20HDL%E4%B8%AD%2C%E6%95%B4%E5%9E%8B%E5%B8%B8%E9%87%8F%E5%8D%B3%E6%95%B4%E5%B8%B8%E6%95%B0%E6%9C%89%E4%BB%A5%E4%B8%8B%E5%9B%9B%E7%A7%8D%E8%BF%9B%E5%88%B6%E8%A1%A8%E7%A4%BA%E5%BD%A2%E5%BC%8F%3A%

版权

在Verilog HDL中,整型常量即整常数有以下四种进制表示形式:

二进制整数(b或B)
十进制整数(d或D)
十六进制整数(h或H)
八进制整数(o或O)

对于4’h0，由于是这里的0是十六进制的，它表示二进制的4’b0000，所以是四位的。

对于16’h4012，每个数字表示4位，一共4个数字，所以一共是4＊4＝16位。

对于 8’b10101100 //位宽为8的数的二进制表示, 'b表示二进制

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