vivadoQoR 建议报告 RTL 代码更改示例1

最新推荐文章于 2024-07-15 07:46:55 发布
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RQS_TIMING-201 ： 为 RAM 添加输出寄存器
为 RAM 添加输出寄存器可改进 RAM 读取数据路径的时钟输出 (clock to out) 时间。这样可为布局布线工具提供更多的灵活性， 使其能够实现最优化的 RAM 布局 ， 并提供将寄存器布局到互连结构内而不是布局到 RAM 内的选项 ， 从而实现关键路径最优化。综合工具可轻松推断输出寄存器。此类寄存器必须包含同步复位， 或者不含任何复位。
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cckkppll
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