前言
interface中有一个关键字modport,用来控制信号的方向,同一个信号,在不同的modport中,方向不同,那么在modport中信号的方向是相对谁来言的呢?
一、modport方向是相对modport自身而言
modport方向是相对modport自身而言。如下代码所示,TEST作为testbench的modport,需要时钟clk和响应grant作为输入,输出则是复位rst和请求request;DUT作为待测RTL的modport,需要时钟clk,复位rst和请求request;MONITOR作为testbench中监控的modport,则所有的信号都是输入。
总结
systemverilog中,interface里边,modport指定的信号方向,是相对modport自身而言的。