【fpdlink】DS90UB954-Q1解串器 REFCLK问题调试记录

已于 2022-04-29 11:33:56 修改
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分类专栏： Nvidia Jetson平台相机开发 文章标签： camera fpdlink 954
于 2022-04-29 11:19:13 首次发布
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本文记录了在使用DS90UB954-Q1解串器时遇到的REFCLK问题，包括启动流程检测、REFCLK电压范围的分析，以及尝试使用外部时钟源和检查寄存器等调试步骤。尽管尝试降低REFCLK Vpp，但设备在REFCLK应用时仍无法响应，问题依然存在。

摘要生成于 C知道 ，由 DeepSeek-R1 满血版支持， 前往体验 >

1. 前言

注意到在数据表的第7.4.4节

REFCLK应该应用于DS90UB954-Q1只有当供应轨道高于最低水平

然后，如图55所示，

REFCLK是在供电轨道高于最低水平之前应用的 (REFCLK是在VDD开始上升时应用的)

还注意到DS90UB954-Q1 I2C不ACK时，有一个26MHz REFCLK应用。

然而，当删除REFCLK (REFCLK引脚是打开的)时，

它确实ACK 使用ASEDV-26.000MHZ-LR-T作为一个26MHz反射clk

为什么它在应用26MHz REFCLK时无响应?

参见下面REFCLK的范围捕获。

注意设备运行在VDD_SEL=LOW, VDDIO = 1.8V

2. 检测启动流程

参考954数据表中的图57显示了详细的启动顺序，是否使用同步模式？

能通过显示电源轨道的范围来验证你的电源启动顺序吗?

正在使用同步模式 参阅下面的REFCLK序列 注意PDB在此之后被拉 仍然，954是无响应的，

当REFCLK应用在前一篇文章中描述

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