CRG、CCO是什么

OCC、CRG是啥

简单了解一下DFT知识:
主要有三种基本测试:

1, 边界扫描测试(boundary scan test):测试目标是IO-PAD,利用jtag接口互联以便测试。

2, BIST:测试MEM,MBIST。

3, 扫描测试(APTG):测试目标std logic。

OCC

OCC = on-chip clock
用来做DFT测试,基本原理是在 scan shift 模式下, 选通慢速的ATE 时钟,load 或 unload 扫描链; 在 capture 模式下,对 free-running PLL clock 过滤筛选出 lauch 和 capture clock 进行at-speed 测试。

全速测试就是让芯片工作在自己高倍时钟频率上,这个频率往往是要高过ATE的时钟的。OCC就实现此功能。

在这里插入图片描述

CRG

CRG = clock reset generation

是芯片中的时钟复位产生电路

出于时钟复位结构规范设计和DFT可控的目的,一般会把相关电路放在一个集中的模块中管理,由专门的设计人员按需求进行设计与维护。

对于时钟分频、MUX、切换、DFT测试结构埋入等等,均在模块内部实现。复位类似。
block level的designer只需要从CRG取所需时钟和复位信号,按规则使用即可,不需要了解详细的实现。

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回答: CRG verilog是指Clock and Reset Generator的verilog代码。在设计数字电路中,时钟和复位信号是非常重要的。CRG verilog代码用于生成时钟和复位信号,以确保电路的正确运行。引用\[1\]中提到了在SRAM中进行数据读写时,需要对写入和读取的数据进行特殊处理,其中包括输出预期比较数据的反码。引用\[2\]中提到了SRAM接口B的读写使能信号、读写地址信号、读数据信号和写数据信号等。而引用\[3\]中提到了利用ncverilog仿真工具中的schematic追踪debug分析来提取整个系统的时钟和复位结构图。综合这些信息,CRG verilog代码的作用是生成时钟和复位信号,并确保数据的正确读写。 #### 引用[.reference_title] - *1* *2* [【HISI IC萌新虚拟项目】Package Process Unit模块整体方案·PART3](https://blog.csdn.net/moon9999/article/details/130759172)[target="_blank" data-report-click={"spm":"1018.2226.3001.9630","extra":{"utm_source":"vip_chatgpt_common_search_pc_result","utm_medium":"distribute.pc_search_result.none-task-cask-2~all~insert_cask~default-1-null.142^v91^control_2,239^v3^insert_chatgpt"}} ] [.reference_item] - *3* [IC设计,利用ncverilog工具导出项目的时钟复位结构图方法](https://blog.csdn.net/u011729865/article/details/52444586)[target="_blank" data-report-click={"spm":"1018.2226.3001.9630","extra":{"utm_source":"vip_chatgpt_common_search_pc_result","utm_medium":"distribute.pc_search_result.none-task-cask-2~all~insert_cask~default-1-null.142^v91^control_2,239^v3^insert_chatgpt"}} ] [.reference_item] [ .reference_list ]

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