IP核:DDR2 SDRAM Controller with UniPHY
芯片:DDR2 MT47H-64M16
根据 Datasheet 得到的地址线信息如下图所示:
可以看出,行地址+bank地址+列地址=26位
但是使用 Quartus II生成的 DDR2 SDRAM Controller with UniPHY IP核的地址位是25位的,差了一位,笔者在这里困扰了很长时间。
解惑,先上图,注意看最后一句话,因为DDR2在时钟的上升沿和下降沿都产生数据,所以每次给出的列地址都是偶数的,因此IP核在取列地址时会省略1位,当你的程序控制的列地址变化为0、1、2、3...的时候,内部的变化就是0、2、4、6...
参考资料
External Memory Interface Handbook Volume 3: Reference Material[P358]