单口SRAM模型

已于 2023-09-12 09:27:19 修改
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分类专栏： 数字IC前端设计项目 文章标签： verilog 数字IC设计 数字CI设计
于 2023-07-07 10:47:33 首次发布
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项目：写一个能读能写的单口SRAM模型（公用地址线和数据线）

项目要求：

1.深度是16bit，宽度是8bit

2.不要reset接口

3.testbench使用系统函数$readmemh对其初始化全为F

4.将数据0x55，0x56，……0x5b，0x5c依次写入，并倒叙读出。

rtl代码

tb代码

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