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极好的一份关于PCB叠层设计及阻抗计算的板厂心水总结
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PCB_IPC7085中关于BGA引脚焊盘直径与引脚间距的关系
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好书推荐： 《EMC电磁兼容设计与测试案例分析第3版）》
 

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DDR 布线规范
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Allegro学习笔记——Group_Class和Subclass
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How to use z-copy to create other shapes allegro
https://www.parallel-systems.co.uk/wp-content/uploads/2020/02/zcopy_shapes.pdf

每天进步一点点------Allegro 怎样把铺铜显示关掉，但是走线要显示？
【背景】

铺铜是PCB布线的末尾环节，在PCB设计后期审查中，我们会检查走线的规则，但是铺铜后，不容易看见走线的效果，这时我们需要关闭铺铜显示，但是走线任然要显示。

【解决方法】

执行Setup->User Preference命令，在Categories中选择Shape，在右面的选项中勾选no_shape_fill

https://blog.csdn.net/albert_xjf/article/details/130780344

https://blog.csdn.net/weixin_42687592/article/details/123462427   RLC谐振电路简单计算公式 ！！！

https://blog.csdn.net/csy17729158342/article/details/126385832   谐振仿真分析
  
http://www.edatop.com/ee/191588.html 求解释：电源和地层间的谐振究竟是怎么回事？

https://bbs.elecfans.com/jishu_1687943_1_1.html 电源层和接地层电容 串并谐振公式

https://zhuanlan.zhihu.com/p/525924772  RLC串联谐振电路中谐振频率产生串联谐振原理

https://www.nec.com/zh/global/prod/emistream/key_functions.html#jump1 EMIStream 和 EMC Expert 选项

http://www.dodopcb.com/ziyuan/Allegrojiqiao/70.html  Allegro快捷键定义的几种方法

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https://www.bilibili.com/video/BV16S4y1U7ZG/?spm_id_from=pageDriver&vd_source=614465504b624ea247f4f1fccada307c 手写Verilog用FPGA实现实时图像卷积，用Block Ram缓存图像
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https://www.bilibili.com/video/BV124411o7zP?p=87&vd_source=614465504b624ea247f4f1fccada307c  小哥Cadence Allegro132讲字幕版PCB设计视频教程[第1-100讲]
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https://www.bilibili.com/video/BV117411W7Z4/?vd_source=614465504b624ea247f4f1fccada307c 使用Cadence17.2 OrCAD Allegro绘制小马哥DragonFly四轴飞行器(STM32F4主控)PCB四层板教程
https://www.eet-china.com/mp/a229909.html  PCB的设计全流程和实战总结
https://www.eet-china.com/mp/a277369.html  PCB设计经验——布线注意事项
https://api.eestar.com/article/share/2021/09/cd66c202109232234288178.pdf  兴森阻抗配置总结 第6页非常好！
https://rf.eefocus.com/article/id-332676  清晰理解特性阻抗与阻抗匹配：揭开迷雾，掌握要点！
https://zhuanlan.zhihu.com/p/50377903  PCB阻抗计算  含有si9000的界面说明！！
https://mouser.eetrend.com/content/2018/100009879.html   这样讲解“特性阻抗”、“阻抗匹配”，不信你不懂~ 、、、、、、  特性阻抗=射频电压/射频电流
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特性阻抗的数值上与均匀传输线的瞬时阻抗相等
https://www.eet-china.com/mp/a35414.html   ！~！！！！这篇解释的很好，特征阻抗必须要有参考面，而到参考面的特征阻抗就是到参考面的阻抗处处恒定
https://blog.csdn.net/jbb0523/article/details/7161426  ！~！！！！特性阻抗到底是什么？  --非常好的解释
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https://blog.csdn.net/jk_101/article/details/130691232  信号通过电容后的影响

https://bbs.elecfans.com/jishu_1864122_1_1.html  Allegro 使用技巧你都知道吗

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https://issuu.com/glody/docs/___________________________________  国外电子与通信教材系列 信号完整性分析
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如上图所示
– Z0与线宽W成反比，线宽越大，Z0越小；
– Z0与铜厚成反比，铜厚越厚，Z0越小；
– Z0与介质厚度成正比，介质厚度越厚，Z0越大；
– Z0与介质介电常数的平方根成反比，介电常数越大，Z0越
小。--要获得高的信号传输要求高的阻抗值,从而要低的介电
常数 -- 介电常数是物质相对于真空来说增加电容器电容能力的度量   介电常数是指物质保持电荷的能力   类比为力学动态分析里的弹性 
导线的特性阻抗可以被看作是导线对其上传输的射频能量的阻碍力大小
介电常数是相对介电常数与真空中绝对介电常数乘积。如果有高介电常数的材料放在电场中，电场的强度会在电介质内有可观的下降。
介电常数代表了电介质的极化程度，也就是对电荷的束缚能力.介电常数越大，对电荷的束缚能力越强
FR4板材其介电常数为4.2—4.7，并且随着频率的增加会减小FR4板材其介电常数为4.2—4.7，并且随着频率的增加会减小

http://www.eternal-machinery.com/newsinfo/771433.html  二极管常见7个应用电路

be06969 mos的恒流驱动
bc72133 be93269 bjt三极管恒流驱动

be43997 阻容式驱动

MIPI摄像头与串行转接模组串行接口csi CAMERA ;显示器与串行转接模组接口dsi DISPLAY  --4对差分信号传输图像数据和一对差分时钟信号  100欧姆特征阻抗 10%等长  ck+ -  D0-3(+ -) 

LVDS LCD面板显示器转接板的连接 155m

有经验的设计工程师会在一开始就理清时钟线，明确各种时钟之间的关系，布线的时候就能处理得更好。

并且时钟信号也经常是EMC设计的难点，需要过EMC测试指标的项目要尤其注意。

时钟线除了常规的阻抗控制和等长要求外，还需要注意以下问题：

时钟线尽量选择优选布线层。
时钟信号尽量不要跨份额，更不要沿着分割区布线。
注意时钟信号与其他信号的间距，至少满足3W。
有EMC要求的设计，较长的时钟线尽量选择内层布线。
注意时钟信号的端接匹配。
RJ-45本身接机壳地（保护地PGND）,此地平面要从变压器下面开始与单板内部数字地隔离，变压器中间对应的所有层建议掏空。
所有外来信号都不得在变压器下方布线，更不允许信号从初、次级中间穿过。