解决:使用AD25软件PCB布线时,从芯片引脚画不出线的问题

在画板子时发现选中了芯片引脚,但是拉不出线来,如下图所示:

经过几番折腾,发现应该是设置上的问题,设置了hugNpush obstacle布线模式,其结合了Walkaround(绕开障碍物)+Push(推挤障碍物)功能,确保不违反规则。

发现了问题就好解决了。

有两种办法,第一种是更改规则,比如线宽。

第二种就是更改布线模式,更改未忽略障碍物,布线后可以自己调整,使间距满足要求,我更倾向于第二种。

 

最后可以布出来啦,并且经过线间距调整,也不会报DRC错误~

### 嘉立创PCB设计中批量引脚网络标签导出方法 在嘉立创EDA系统中,批量引脚网络标签的导出可以通过特定的操作流程实现。以下是关于该功能的具体说明: #### 使用场景 在网络复杂度较高的电路设计中,手动逐一设置网络标签可能效率低下且容易出错。因此,嘉立创EDA提供了通过CSV文件进行批量导入和导出的功能,以便更高效地管理和调整网络标签。 #### 操作步骤描述 1. **放置元件并生成初始网络标签** 首先,在嘉立创EDA界面中完成目标元件(如单片机STC89C52RC-40I-LQFP44)的放置操作[^4]。随后,选中该元件并通过右键菜单选择“扇出网络标签”,此系统会自动生成对应的网络标签数据。 2. **导出原始网络标签至CSV文件** 完成上述操作后,可以进一步执行导出命令,将当前的网络标签信息保存到本地计算机上的CSV文件中。此过程能够保留所有必要的网络连接关系及其属性信息。 3. **编辑CSV文件中的网络名称** 利用合适的表格处理软件打开所导出的CSV文件,并按照具体项目需求修改其中的各项`netname`字段值。需要注意的是,如果采用某些办公套件(例如WPS)来进行此类更改,则务必确认最终保存格式仍保持兼容性良好——通常建议直接存回标准CSV形式而非其他扩展名版本。 4. **重新加载更新后的网络配置** 修改完毕之后再次回到嘉立创EDA平台内相应位置处,依照先前相同路径上传经过修订版的新版CSV文档即可成功应用新的命名方案给定各个节点之间关联定义。 以上即为整个利用嘉立创EDA实施大规模自动化分配各端口对应逻辑标识符的整体解决方案概述。 ```python # 示例代码片段展示如何读取 CSV 文件内容 (仅作演示用途) import csv def read_network_labels(file_path): with open(file_path, mode='r', encoding='utf-8') as file: reader = csv.DictReader(file) for row in reader: net_name = row['NetName'] pin_number = row['PinNumber'] print(f"Network Label: {net_name}, Pin Number: {pin_number}") read_network_labels('example.csv') ```
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