【python脚本】用于生成简单握手接口与自测环境的gen_uvm_agent脚本

尼德兰的喵

已于 2022-12-01 16:02:45 修改

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分类专栏：芯片前端脚本芯片前端经验分享与工具发布芯片前端验证文章标签：芯片 verilog python

于 2022-08-29 08:00:00 首次发布

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前言

由于后续的工作需要，大概率会进行一些验证的工作，因此我非常机智的先把gen_uvm_agent脚本写好。gen_uvm_agent只用来生成简单的握手型接口的全套代码，同时也会生成一个自测环境用于行为确认。

1.键入agent的名字，比如vbn：

[xiaotu@xiaotu-eda ~/Git_Path/gen_uvm_agent/gen_uvm_agent]$./gen_uvm_agent vbn

2.如果当前目录有vbn.cfg，则直接读取，否则跳出来一个配置文件，配置一下；可配置选项只有三个：

SIGNAL WIDTH RANDOM(Y/N)
data   32    Y
crc    8     N
last   1     Y

SIGNAL：接口的信号名，默认所有的transaction的信号都会被打到接口上；

WIDTH：信号位宽，只支持数字；

RANDOM：是否为rand信号；

3.报错cfg文件，之后键入y：

/home/xiaotu/Git_Path/gen_uvm_agent/gen_uvm_agent/./gen_uvm_agent is working
Please input y after complete: y

4.进入vbn_utils/test/目录，make cmp，检查有无编译问题：

if [ -x .././sim_base/exec/simv ]; then chmod -x .././sim_base/exec/simv; fi
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