对样例SoC集成example salve模块

最新推荐文章于 2023-05-04 10:40:29 发布

北枫凉

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分类专栏：使用M0 DesignStart 的样例SoC 文章标签： CortexM0集成

本文链接：https://blog.csdn.net/qq_34686440/article/details/116562730

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使用M0 DesignStart 的样例SoC 专栏收录该内容

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已经了解了，CortexM0只有一个AHB-lite master，没有bus matrix

接下来还需要弄清decoder和AHB-lite的关系

AHB salve multiplexer：反馈给master

具体步骤

理解cmsdk example slave代码

AHB协议

bus interconnection

CMSDK提供的IP

AHB emample slave

提供了ahb interface 以及slave reg

需要改动的地方

decoder：产生一个sel信号

AHB salve multiplexer：反馈给master

具体步骤

理解cmsdk example slave代码

添加到rtl目录中

vcs的filelist常用的选项

-y 选项：在该目录下查找模块

-y <directory_pathname>
Specifies a Verilog library directory to search for module definitions.

也就是将模块的定义放在这个地方

举例：

-y ../../../logical/cmsdk_apb_timer/verilog

在这个目录下存放的就是cmsdk_apb_timer.v模块

+incdir+选项：在该目录下查找`inlcude *****包含的文件

+incdir+<directory>
Specifies the directories that contain the files you specified with
the `include compiler directive. You can specify more that one
directory, separating each path name with the + character.

举例：

+incdir+../verilog

在这个目录下查找模块中`include 包含的文件

+libext+选项：指定搜索的扩展名，使用-y选项的时候使用

+libext+<extension>
Specifies that VCS only search the source files in a Verilog library
directory with the specified extension. You can specify more than one
extension, separating each extension with the + character.
For example, +libext++.v specifies searches library files with no
extension and library files with the .v extension.
Enter this option when you enter the -y option.

举例：

+libext+.v+.vlib

-y选项搜索的文件扩展名为.v文件