HDLBits-Minimum SOP and POS

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分类专栏： HDLBits 文章标签： fpga verilog
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本文探讨了一个四输入单输出数字系统，当输入为2, 7或15时输出1，其他情况输出0。由于3, 8, 11, 和12在系统中不会出现，故在构造最小SOP（与非）和POS（或非）表达式时，可将这些值视为任意。通过卡诺图分析，以最优化的方式确定输出out_sop和out_pos。" 129324350,17586178,Java实现的大学生志愿者服务管理系统,"['Java开发', '课程设计', '数据库设计', 'Mybatis框架', 'Web应用']

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A single-output digital system with four inputs (a,b,c,d) generates a logic-1 when 2, 7, or 15 appears on the inputs, and a logic-0 when 0, 1, 4, 5, 6, 9, 10, 13, or 14 appears. The input conditions for the numbers 3, 8, 11, and 12 never occur in this system. For example, 7 corresponds to a,b,c,d being set to 0,1,1,1, respectively.

Determine the output out_sop in minimum SOP form, and the output out_pos in minimum POS form.

        

题目中说3,8,11,12在系统中不会出现，所以在卡诺图中可以将其表示为d，在画卡诺圈的时候视d为任意，然后尽量圈得更多。

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