基于FPGA的IP分片重组系统设计

本文提出了一种基于FPGA的IP分片重组系统设计,旨在解决网络通信中数据处理效率问题。通过FPGA的硬件并行性,该系统能快速定位和重组IP分片数据报,提高TCP/IP传输效率。设计中详细描述了哈希算法和重组策略,并通过仿真和硬件验证证实了其高效性。

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摘 要:信息技术与信息化 基于FPGA的IP分片重组系统设计 王 彬1 王秀翠2 WANG Bin WANG Xiucui 针对一般通信设备的数据处理能力无法满足复杂程度越来越高、数据量越来越大的网络通信要求,提出 了基于现场可编程门阵列(fi eld programmable gate array, FPGA)的网际互连协议(internet protocol, IP) 分片重组系统。首先,分析了传输控制协议/网际协议(transmission control protocol/internet protocol, TCP/IP)协议中,IP层的数据格式及特征;然后,结合FPGA具有硬件并行性和数据处理延迟固定等 特点,对IP分片数据报重组模块及其内部重组仲裁子模块的架构进行了设计;同时,详细描述了哈希 算法及IP分片数据报重组算法;最后,完成了系统模块的接口设计、编码实现及仿真和硬件验证。通 过仿真验证和硬件板级验证,该设计能够快速定位当前IP分片数据报的所属分组,并完成重组,大大 提高TCP/IP的传输效率。

关键词: 网络通信;FPGA;TCP/IP;IP分片;哈希算法

0 引言

        随着网络通信的复杂程度越来越高、数据量越来越大, 对通信设备

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